參數(shù)資料
型號： MC3S12XEP100F1CAGR
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP144
封裝： LQFP-144
文件頁數(shù)： 583/1324頁
文件大?。?/td> 8453K
代理商： MC3S12XEP100F1CAGR
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Chapter 8 S12X Debug (S12XDBGV3) Module
MC9S12XE-Family Reference Manual , Rev. 1.21
330
Freescale Semiconductor
Because of an order from the United States International Trade Commission, BGA-packaged product lines and partnumbers
indicated here currently are not available from Freescale for import or sale in the United States prior to September 2010
this triggers the state sequencer into the Final State, if congured for end alignment, setting the TRIG bit
disarms the module, ending the session. If breakpoints are enabled, a forced breakpoint request is issued
immediately (end alignment) or when tracing has completed (begin or mid alignment).
8.4.3.6
Trigger Priorities
In case of simultaneous triggers, the priority is resolved according to Table 8-42. The lower priority trigger
is suppressed. It is thus possible to miss a lower priority trigger if it occurs simultaneously with a trigger
of a higher priority. The trigger priorities described in Table 8-42 dictate that in the case of simultaneous
matches, the match on the lower channel number (0,1,2,3) has priority. The SC[3:0] encoding ensures that
a match leading to nal state has priority over all other matches in each state sequencer state. When
congured for range modes a simultaneous match of comparators A and C generates an active match0
whilst match2 is suppressed.
If a write access to DBGC1 with the ARM bit position set occurs simultaneously to a hardware disarm
from an internal trigger event, then the ARM bit is cleared due to the hardware disarm.
8.4.4
State Sequence Control
Figure 8-22. State Sequencer Diagram
The state sequencer allows a dened sequence of events to provide a trigger point for tracing of data in the
trace buffer. Once the S12XDBG module has been armed by setting the ARM bit in the DBGC1 register,
Table 8-42. Trigger Priorities
Priority
Source
Action
Highest
XGATE BKP
Immediate forced breakpoint......(Tracing terminated immediately).
TRIG
Trigger immediately to nal state (begin or mid aligned tracing enabled)
Trigger immediately to state 0 (end aligned or no tracing enabled)
External TAGHI/TAGLO
Enter State0
Match0 (force or tag hit)
Trigger to next state as dened by state control registers
Match1 (force or tag hit)
Trigger to next state as dened by state control registers
Match2 (force or tag hit)
Trigger to next state as dened by state control registers
Lowest
Match3 (force or tag hit)
Trigger to next state as dened by state control registers
State1
Final State
State3
ARM = 1
Session Complete
(Disarm)
State2
State 0
(Disarmed)
ARM = 0
相關PDF資料
PDF描述
MC9S12XEP100F1VAL 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP112
MC3S12XEP100F1CAL 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP112
MC9S12XEP100F1CALR 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP112
MC9S12XEP100F1VAAR 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP80
MC9S12XEP100J1CAA 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP80
相關代理商/技術(shù)參數(shù)
參數(shù)描述
MC3S12XEP100F1CALR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers
MC3S12XEP100F1CVLR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers
MC3S12XEP100F1MAAR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers
MC3S12XEP100F1MAGR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers
MC3S12XEP100F1MALR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers
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