參數資料
型號: MC68HC11P1CFN3R2
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, EEPROM, 3 MHz, MICROCONTROLLER, PQCC84
封裝: PLASTIC, LCC-84
文件頁數: 164/236頁
文件大小: 1232K
代理商: MC68HC11P1CFN3R2
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MC68HC11P2
MOTOROLA
2-9
PIN DESCRIPTIONS
2
WEN — WAIT enable
1 (set)
Low-power WAIT mode selected (PLL set to ‘idle’ in WAIT mode).
0 (clear) –
Do not alter the 4XCLK during WAIT mode.
This bit determines whether the 4XCLK is disconnected from VCOOUT during WAIT and
connected to EXTAL. Reset clears this bit.
When set, the CPU will respond to a WAIT instruction by rst stacking the relevant registers, then
by clearing BCS and setting the PLL to ‘idle’, with modulus = 1.
Any interrupt, any reset, or the assertion of RAF in any of the SCIs will allow the PLL to resume
operating at the frequency specied in the SYNR. The user must set BCS after the PLL has had
time to adjust (tPLLS). If, for a specic SCI, the RE bit is clear, then RAF cannot become set, hence
the PLL will not resume normal operation.
2.5.3.2
SYNR — Synthesizer program register
The PLL frequency synthesizer multiplies the frequency of the crystal oscillator. The multiplication
factor is software programmable via a loop divider, which consists of a six-bit modulo N counter,
with a further two bit scaling factor.
The multiplication factor is given by 2(Y + 1)2X, where 0
≤ X ≤ 3 and 0 ≤ Y ≤ 63.
Note:
Exceeding recommended operating frequencies can result in indeterminate MCU operation.
SYNX[1:0]
These bits program the binary taps (divide by 1, 2, 4 and 8). Reset clears these bits.
SYNY[5:0]
These bits program the six-bit modulo N (1 to 64) counter. Reset sets these bits to %001011.
Note:
The resolution of the multiplication factors decreases by a factor of two, as X increases:
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
Synthesizer program (SYNR)
$002F
SYNX1 SYNX0 SYNY5 SYNY4 SYNY3 SYNY2 SYNY1 SYNY0 0000 1011
X
Y
Possible multipliers
0
0 63
2, 4, 6, 8, , 128
1
0 63
4, 8, 12, 16, , 256
2
0 63
8, 16, 24, 32, , 512
3
0 63
16, 32, 48, 64, , 1024
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