參數(shù)資料
型號: MC68HC11P1CFN3R2
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, EEPROM, 3 MHz, MICROCONTROLLER, PQCC84
封裝: PLASTIC, LCC-84
文件頁數(shù): 50/236頁
文件大小: 1232K
代理商: MC68HC11P1CFN3R2
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MC68HC11P2
MOTOROLA
8-21
TIMING SYSTEM
8
8.7
Pulse-width modulation (PWM) timer
The PWM timer subsystem provides up to four 8-bit pulse-width modulated waveforms on the port
H pins. Channel pairs can be concatenated to create 16-bit PWM outputs. Three clock sources
(A, B, and S) and a exible clock select scheme give the PWM a wide range of frequencies.
Four control registers congure the PWM outputs — PWCLK, PWPOL, PWSCAL, and PWEN.
The PWCLK register selects the prescale value for the PWM clock sources and enables the 16-bit
PWM functions. The PWPOL register determines each channel’s polarity and selects the clock
source for each channel. The PWSCAL register derives a user-scaled clock based on the A clock
source, and the PWEN register enables the PWM channels.
Each channel also has a separate 8-bit counter, period register, and duty cycle register. The period
and duty cycle registers are double buffered so that if they are changed while the channel is
enabled, the change does not take effect until the counter rolls over or the channel is disabled. A
new period or duty cycle can be forced into effect immediately by writing to the period or duty cycle
register and then writing to the counter.
With PWMs congured for 8-bit mode and E equal to 4MHz, PWM signals can be produced from
40 kHz (1% duty cycle resolution) to less than 10 cycles per second (approximately 0.4% duty
cycle resolution). By conguring the PWMs for 16-bit mode with E equal to 4MHz, PWM periods
greater than one minute are possible.
In 16-bit mode, duty cycle resolution of up to 15 parts per million can be achieved (at a PWM
frequency of 60Hz). In the same system, a PWM frequency of 1kHz corresponds to a duty cycle
resolution of 0.025%.
8.7.1
PWM timer block diagram
Figure 8-4 shows the block diagram of the PWM timer subsystem. Three different clock sources
are selectable and provide inputs to the control registers. Each of the four channels has a counter,
a period register, and a duty register. The waveform output is the result of a match between the
period register (PWPERx) and the value in the counter (PWCNTx). The duty register (PWDTYx)
changes the state of the output during the period to determine the duty cycle.
Pin
Alternate
function
PH0
PW1
PH1
PW2
PH2
PW3
PH3
PW4
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PDF描述
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