參數(shù)資料
型號： MC68HC805K3DW
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, EEPROM, 2 MHz, MICROCONTROLLER, PDSO16
封裝： SOIC-16
文件頁數(shù)： 101/119頁
文件大?。?/td> 496K
代理商： MC68HC805K3DW
General Release Specication
PEEPROM Registers
MC68HC805K3 — Rev. 1.0
82
Personality EEPROM
MOTOROLA
9.3.2 PEEPROM Status/Control Register (PESCR)
The PEEPROM Status/Control Register is located at $000F and
contains 5 user bits, as shown in Figure 9-3. Bit 1 is unimplemented and
always reads as a logic zero. The states of all bits except PEPCZF and
PEDATA are cleared by reset. The PEPCZF is set by reset; and the state
of the PEDATA bit following reset is dependent on the stored data in bit
0 of the PEEPROM array.
PEPCZF — PEEPROM Column Zero Flag
The PEPCZF is a flag bit that is set to a logical one when the first
column (COL0) of the EEPROM array is selected. If any other column
is selected, the PEPCZF flag bit is cleared. This flag bit can be used
to reduce the software code required to access one byte of the
PEEPROM. The PEPCZF is set following a reset, since the first
column is selected by the reset of the PEBSR. The software code
given in Table 9-1 is suggested for reading one byte from the
PEEPROM.
$0F
Bit 7
6
5
4
3
2
1
Bit 0
Read: PEDATA
PEBULK
PEPGM
(DATA IN)
PEBYTE
CPEN
CPCLK
0
PEPCZF
Write:
Reset:
1
0
1
= Unimplemented
Figure 9-3. PESCR Status/Control Register
相關PDF資料
PDF描述
MC68HC812A4PV8 16-BIT, EEPROM, 8 MHz, MICROCONTROLLER, PQFP112
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MC68HC908AS32AMFNE 8-BIT, FLASH, 8.4 MHz, MICROCONTROLLER, PQCC52
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參數(shù)描述
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