參數(shù)資料
型號： MCHC908JK8CPE
廠商： Freescale Semiconductor
文件頁數(shù)： 151/212頁
文件大?。?/td> 0K
描述： IC MCU 8K FLASH 8MHZ 20-DIP
標準包裝： 18
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： SCI
外圍設備： LED，LVD，POR，PWM
輸入/輸出數(shù)： 15
程序存儲器容量： 8KB（8K x 8）
程序存儲器類型： 閃存
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉換器： A/D 13x8b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-DIP（0.300"，7.62mm）
包裝： 管件
產(chǎn)品目錄頁面： 725 (CN2011-ZH PDF)
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Configuration Register 2 (CONFIG2)
MC68HC908JL8/JK8 MC68HC08JL8/JK8 MC68HC908KL8 Data Sheet, Rev. 3.1
Freescale Semiconductor
43
3.4 Configuration Register 2 (CONFIG2)
IRQPUD — IRQ Pin Pull-Up Disable Bit
IRQPUD disconnects the internal pull-up on the IRQ pin.
1 = Internal pull-up is disconnected
0 = Internal pull-up is connected between IRQ pin and VDD
LVIT1, LVIT0 — LVI Trip Voltage Selection Bits
Detail description of trip voltage selection is given in Chapter 15 Low Voltage Inhibit (LVI).
STOP_ICLKDIS — Internal Oscillator Stop Mode Disable Bit
Setting STOP_ICLKDIS disables the internal oscillator during stop mode. When this bit is cleared, the
internal oscillator continues to operate in stop mode. Reset clears this bit.
1 = Internal oscillator disabled during stop mode
0 = Internal oscillator enabled during stop mode
3.5 Mask Option Register (MOR)
The mask option register (MOR) is implemented as a byte within the FLASH memory, and therefore can
only be written during a programming sequence of the FLASH memory. This register is read after a
power-on reset to determine the type of oscillator selected. (See Chapter 6 Oscillator (OSC).)
OSCSEL — Oscillator Select Bit
OSCSEL selects the oscillator type for the MCU. The erased or unprogrammed state of this bit is
logic 1, selecting the crystal oscillator option. This bit is unaffected by reset.
1 = Crystal oscillator
0 = RC oscillator
Address:
$001E
Bit 7
654321
Bit 0
Read:
IRQPUD
R
LVIT1
LVIT0
R
STOP_
ICLKDIS
Write:
Reset:
000
Not affected Not affected
000
POR:
00000000
R= Reserved
One-time writable register after each reset. LVIT1 and LVIT0 reset to logic 0 by a power-on reset (POR) only.
Figure 3-2. Configuration Register 2 (CONFIG2)
Address:
$FFD0
Bit 7
654321
Bit 0
Read:
OSCSEL
RRRRRRR
Write:
Erased:
11111111
Reset:
Unaffected by reset
Non-volatile FLASH register; write by programming.
R= Reserved
Figure 3-3. Mask Option Register (MOR)
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PDF描述
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