參數(shù)資料
型號： MCHC908JK8CPE
廠商： Freescale Semiconductor
文件頁數(shù)： 91/212頁
文件大?。?/td> 0K
描述： IC MCU 8K FLASH 8MHZ 20-DIP
標(biāo)準(zhǔn)包裝： 18
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： SCI
外圍設(shè)備： LED，LVD，POR，PWM
輸入/輸出數(shù)： 15
程序存儲器容量： 8KB（8K x 8）
程序存儲器類型： 閃存
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 13x8b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-DIP（0.300"，7.62mm）
包裝： 管件
產(chǎn)品目錄頁面： 725 (CN2011-ZH PDF)
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Break Module (BREAK)
MC68HC908JL8/JK8 MC68HC08JL8/JK8 MC68HC908KL8 Data Sheet, Rev. 3.1
180
Freescale Semiconductor
16.3.1 Flag Protection During Break Interrupts
The system integration module (SIM) controls whether or not module status bits can be cleared during
the break state. The BCFE bit in the break flag control register (BFCR) enables software to clear status
bits during the break state. (See 5.7.3 Break Flag Control Register (BFCR) and see the Break Interrupts
subsection for each module.)
16.3.2 CPU During Break Interrupts
The CPU starts a break interrupt by:
Loading the instruction register with the SWI instruction
Loading the program counter with $FFFC:$FFFD
($FEFC:$FEFD in monitor mode)
The break interrupt begins after completion of the CPU instruction in progress. If the break address
register match occurs on the last cycle of a CPU instruction, the break interrupt begins immediately.
16.3.3 TIM During Break Interrupts
A break interrupt stops the timer counter.
16.3.4 COP During Break Interrupts
The COP is disabled during a break interrupt when VTST is present on the RST pin.
Addr.
Register Name
Bit 7
654321
Bit 0
$FE00 Break Status Register (BSR)
Read:
RRRRRR
SBSW
R
Write:
See note
Reset:
0
$FE03
Break Flag Control
Register
(BFCR)
Read:
BCFE
RRRRRRR
Write:
Reset:
0
$FE0C
Break Address High
Register
(BRKH)
Read:
Bit15
Bit14
Bit13
Bit12
Bit11
Bit10
Bit9
Bit8
Write:
Reset:
00000000
$FE0D
Break Address low
Register
(BRKL)
Read:
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
Write:
Reset:
00000000
$FE0E
Break Status and Control
Register
(BRKSCR)
Read:
BRKE
BRKA
000000
Write:
Reset:
00000000
Note: Writing a logic 0 clears SBSW.
= Unimplemented
R
= Reserved
Figure 16-2. Break I/O Register Summary
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PDF描述
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