參數(shù)資料
型號(hào)： MCHC908JK8CPE
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 49/212頁(yè)
文件大?。?/td> 0K
描述： IC MCU 8K FLASH 8MHZ 20-DIP
標(biāo)準(zhǔn)包裝： 18
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： SCI
外圍設(shè)備： LED，LVD，POR，PWM
輸入/輸出數(shù)： 15
程序存儲(chǔ)器容量： 8KB（8K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 13x8b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-DIP（0.300"，7.62mm）
包裝： 管件
產(chǎn)品目錄頁(yè)面： 725 (CN2011-ZH PDF)
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Serial Communications Interface (SCI)
MC68HC908JL8/JK8 MC68HC08JL8/JK8 MC68HC908KL8 Data Sheet, Rev. 3.1
142
Freescale Semiconductor
9.8.5 SCI Status Register 2
SCI status register 2 contains flags to signal the following conditions:
Break character detected
Incoming data
BKF — Break Flag Bit
This clearable, read-only bit is set when the SCI detects a break character on the RxD pin. In SCS1,
the FE and SCRF bits are also set. In 9-bit character transmissions, the R8 bit in SCC3 is cleared. BKF
does not generate a CPU interrupt request. Clear BKF by reading SCS2 with BKF set and then reading
the SCDR. Once cleared, BKF can become set again only after logic 1s again appear on the RxD pin
followed by another break character. Reset clears the BKF bit.
1 = Break character detected
0 = No break character detected
RPF — Reception in Progress Flag Bit
This read-only bit is set when the receiver detects a logic 0 during the RT1 time period of the start bit
search. RPF does not generate an interrupt request. RPF is reset after the receiver detects false start
bits (usually from noise or a baud rate mismatch) or when the receiver detects an idle character. Polling
RPF before disabling the SCI module or entering stop mode can show whether a reception is in
progress.
1 = Reception in progress
0 = No reception in progress
9.8.6 SCI Data Register
The SCI data register (SCDR) is the buffer between the internal data bus and the receive and transmit
shift registers. Reset has no effect on data in the SCI data register.
R7/T7–R0/T0 — Receive/Transmit Data Bits
Reading the SCDR accesses the read-only received data bits, R[7:0]. Writing to the SCDR writes the
data to be transmitted, T[7:0]. Reset has no effect on the SCDR.
NOTE
Do not use read/modify/write instructions on the SCI data register.
Address:
$0017
Bit 7
654321
Bit 0
Read:
BKF
RPF
Write:
Reset:
00000000
= Unimplemented
Figure 9-14. SCI Status Register 2 (SCS2)
Address:
$0018
Bit 7
654321
Bit 0
Read:
R7R6R5
R4R3R2
R1
R0
Write:
T7
T6
T5
T4
T3
T2
T1
T0
Reset:
Unaffected by reset
Figure 9-15. SCI Data Register (SCDR)
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