參數(shù)資料
型號： MCIMX258CVM4
廠商： Freescale Semiconductor
文件頁數(shù)： 103/153頁
文件大?。?/td> 0K
描述： IC MPU I.MX25 IND 400MAPBGA
標準包裝： 90
系列： i.MX25
核心處理器： ARM9
芯體尺寸： 32-位
速度： 400MHz
連通性： 1 線，CAN，EBI/EMI，以太網，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB OTG
外圍設備： DMA，I²S，LCD，POR，PWM，WDT
輸入/輸出數(shù)： 128
程序存儲器類型： 外部程序存儲器
RAM 容量： 144K x 8
電壓 - 電源 (Vcc/Vdd)： 1.15 V ~ 1.52 V
數(shù)據轉換器： A/D 3x12b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 400-LFBGA
包裝： 托盤
i.MX25 Applications Processor for Consumer and Industrial Products, Rev. 10
Freescale Semiconductor
53
3.7.4.2
Ungated Clock Mode Timing
Figure 22 shows the ungated clock mode timings of CSI, and Table 42 describes the timing parameters
(P1–P6) that are shown in the figure. In ungated mode the VSYNC and PIXCLK signals are used, and the
HSYNC signal is ignored.
Figure 22. CSI Ungated Clock Mode—Sensor Data at Falling Edge, Latch Data at Rising Edge
Table 41. CSI Gated Clock Mode Timing Parameters
ID
Parameter
Symbol
Min.
Max.
Units
P1
CSI VSYNC to HSYNC time
tV2H
67.5
—
ns
P2
CSI HSYNC setup time
tHsu
1
—
ns
P3
CSI DATA setup time
tDsu
1
—
ns
P4
CSI DATA hold time
tDh
1.2
—
ns
P5
CSI pixel clock high time
tCLKh
10
—
ns
P6
CSI pixel clock low time
tCLKl
10
—
ns
P7
CSI pixel clock frequency
fCLK
—
48
± 10%
MHz
Table 42. CSI Ungated Clock Mode Timing Parameters
ID
Parameter
Symbol
Min.
Max.
Units
P1
CSI VSYNC to pixel clock time
tVSYNC
67.5
—
ns
P2
CSI DATA setup time
tDsu
1
—
ns
P3
CSI DATA hold time
tDh
1.2
—
ns
P4
CSI pixel clock high time
tCLKh
10
—
ns
P5
CSI pixel clock low time
tCLKl
10
—
ns
P6
CSI pixel clock frequency
fCLK
—
48
± 10%
MHz
PIXCLK
VSYNC
DATA[15:0]
P4
P1
P2
P3
P5
P6
相關PDF資料
PDF描述
MCIMX257DVM4 IC MPU I.MX25 COMM 400MAPBGA
MCIMX257CVM4 IC MPU I.MX25 IND 400MAPBGA
1061541121 ADPT OPT MULTIMODE SC-ST BEIGE
S9S08DN32F1MLH IC MCU 8BIT 32KB FLASH 64LQFP
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