參數(shù)資料
型號： MPC823ZT50
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, RISC PROCESSOR, PBGA256
封裝： 23 X 23 MM, 1.27 MM PITCH, PLASTIC, BGA-256
文件頁數(shù)： 163/1407頁
文件大?。?/td> 13074K
代理商： MPC823ZT50
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Development Capabilities and Interface
MOTOROLA
MPC823 USER’S MANUAL
20-31
DEVELOPMENT
20
CAPABILITIES
&
INTERFACE
The instructions or data are then transferred in parallel to the core and TECR. When the
processor enters debug mode it fetches instructions from the DPIR, which causes an access
to the development interface port shift register. These instructions are serially loaded into
the shift register from the DSDI using DSCK or CLKOUT as the shift clock. Similarly, data is
transferred to the core. Data is shifted into the shift register and read by the processor when
a “move from special-purpose register DPDR” instruction is executed. Data is also parallel
loaded into the development interface port shift register from the core by executing a “move
to special-purpose register DPDR” instruction. It is then serially shifted out to the DSDO pin
using DSCK or CLKOUT as the shift clock.
20.4.3.5.2 Trap Enable Control Register. The 9-bit trap enable control register (TECR) is
loaded from the development interface port shift register. The contents of the control register
drive the six trap enable signals, two breakpoint signals, and the VSYNC signal to the core.
The transfer data to trap enable control register commands are used to force the appropriate
bits to be transferred to this register. The trap enable control register is not accessed by the
core, but supplies signals to the core. The trap enable bits, VSYNC bit, and the breakpoint
bits of this register are loaded from the development interface port shift register as a result
of trap enable mode transmissions. The trap enable bits are reflected in the ICTRL and
LCTRL2 special registers. Refer to Section 20.6.2 Development Port Registers for more
information on the support registers.
20.4.3.5.3 Decoding the Development Interface Port Registers. The development
interface port shift register is selected when the core accesses the DPIR or DPDR registers.
Accesses to these two special-purpose registers occur in debug mode and appear on the
internal bus as an address and the assertion of an address attribute signal indicating that a
special-purpose register is being accessed. The DPIR is read by the core to fetch all
instructions when in debug mode. The DPDR is read and written to transfer data between
the core and external development tools. The DPIR and DPDR are pseudo-registers, so
decoding either of these registers causes the development interface port shift register to be
accessed. The debug mode logic knows whether the core is fetching instructions or reading
or writing data. A sequence error is signaled to the external development tool when the core
expected result and the GPR result do not match. An example of this would be when an
instruction is received instead of the expected data.
20.4.3.6 DEVELOPMENT PORT SERIAL COMMUNICATION. All serial transmissions
are synchronous, with respect to the transmission clock.
20.4.3.6.1 Clock Mode Selection. With respect to CLKOUT, the transmission clock can
either be synchronous or asynchronous. The development port has two methods that can
be used to clock serial transmissions. The first method allows the transmission to occur
without being externally synchronized to CLKOUT. In this mode, a serial clock DSCK must
be supplied to the MPC823. The other communication method requires data to be externally
synchronized with respect to CLKOUT.
相關(guān)PDF資料
PDF描述
MPC823CZT25 32-BIT, RISC PROCESSOR, PBGA256
MPC823ZT25 32-BIT, RISC PROCESSOR, PBGA256
MPC8241LVR200X 32-BIT, 200 MHz, RISC PROCESSOR, PBGA357
MPC8241LVR166X 32-BIT, 166 MHz, RISC PROCESSOR, PBGA357
MPC8241LVR266D 32-BIT, 266 MHz, RISC PROCESSOR, PBGA357
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MPC8240 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Hardware Specifications
MPC8240EC 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Hardware Specifications
MPC8241 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Intergrated Processor Hardware Specifications
MPC8241EC 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC8241 Integrated Processor Hardware Specifications
MPC8241LVR166D 功能描述:微處理器 - MPU INTEGRATED HOST PROC RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
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