參數(shù)資料
型號(hào)： MPC823ZT50
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, RISC PROCESSOR, PBGA256
封裝： 23 X 23 MM, 1.27 MM PITCH, PLASTIC, BGA-256
文件頁數(shù)： 593/1407頁
文件大?。?/td> 13074K
代理商： MPC823ZT50
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Instruction Cache
MOTOROLA
MPC823 USER’S MANUAL
9-11
INSTRUCTION
CACHE
9
9.4.4 Unlocking the Entire Instruction Cache
The UNLOCK ALL command is used to unlock the entire instruction cache. This operation
is privileged and any attempt to perform it when the core is in the problem state (MSRPR =1)
results in a program interrupt. It is performed on all cache lines. If a line is locked, it is
unlocked and operates as a regular valid cache line. If a line is not locked or if it is invalid,
no operation occurs. To unlock the whole cache, set the UNLOCK ALL command in the
IC_CSR. This command has no associated error cases. The instruction cache performs this
instruction in one clock cycle. To accurately calculate the latency of this instruction, bus
latency should be taken into consideration.
9.4.5 Inhibiting the Instruction Cache
In the MPC823, there are two ways to inhibit the cache—using the MMU cache-inhibit
attribute or the cache disable mode. To disable the instruction cache, set the CACHE
DISABLE command in the IC_CSR. This operation is privileged and any attempt to perform
it when the core is in the problem state (MSRPR =1) results in a program interrupt. This
command has no error cases that you need to check.
To enable the instruction cache, set the CACHE ENABLE command in the IC_CSR. This
operation is privileged and any attempt to perform it when the core is in the problem state
(MSRPR =1) results in a program interrupt. This command has no error cases that you need
to check. When fetching from cache-inhibited regions the full line is brought to the internal
burst buffer. Instructions that originate in a cache-inhibited region and are stored in the burst
buffer can be sent to the MPC823 core no more than once before being refetched. In the
memory management unit, a memory region can be programmed as cache-inhibited. When
changing a memory region to be cache inhibited, you must unlock all previously locked lines
containing code that originated in this memory region, invalidate all lines containing code
that originated in this memory region, and execute an isync instruction.
When the MPC823 asserts the FRZ signal, it indicates that the MPC823 is under debug and
all fetches from the cache are treated as if they were from the cache-inhibited memory
region. For more information on cache debug support, refer to Section 9.9 Debug Support.
Note: Failure to follow these steps causes code from cache-inhibited regions to be left
inside the cache and any reference to these regions will result in a cache hit. If
a reference to a cache-inhibited region results in a cache hit, the data is sent to
the core from the cache and not from memory.
相關(guān)PDF資料
PDF描述
MPC823CZT25 32-BIT, RISC PROCESSOR, PBGA256
MPC823ZT25 32-BIT, RISC PROCESSOR, PBGA256
MPC8241LVR200X 32-BIT, 200 MHz, RISC PROCESSOR, PBGA357
MPC8241LVR166X 32-BIT, 166 MHz, RISC PROCESSOR, PBGA357
MPC8241LVR266D 32-BIT, 266 MHz, RISC PROCESSOR, PBGA357
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MPC8240 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Hardware Specifications
MPC8240EC 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Hardware Specifications
MPC8241 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Intergrated Processor Hardware Specifications
MPC8241EC 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC8241 Integrated Processor Hardware Specifications
MPC8241LVR166D 功能描述:微處理器 - MPU INTEGRATED HOST PROC RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
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