參數(shù)資料
型號： MPC866PCZP100
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 100 MHz, RISC PROCESSOR, PBGA256
封裝： 23 X 23 MM, PLASTIC, BGA-256
文件頁數(shù)： 1001/1358頁
文件大小： 14179K
代理商： MPC866PCZP100
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MOTOROLA
Chapter 22. SCC UART Mode
22-13
PRELIMINARY—SUBJECT TO CHANGE WITHOUT NOTICE
Handling Errors in the SCC UART Controller
Reception errors are described in Table 22-8.
Table 22-7. Transmission Errors
Error
Description
CTS Lost during
Character
Transmission
When CTS negates during transmission, the channel stops after nishing the current character. The
CP sets TxBD[CT] and generates the TX interrupt if it is not masked. The channel resumes
transmission after the RESTART TRANSMIT command is issued and CTS is asserted.
Note that if CTS is used, the UART also offers an asynchronous ow control option that does not
generate an error. See the description of PSMR[FLC] in Table 22-9.
Table 22-8. Reception Errors
Error
Description
Overrun
Occurs when the channel overwrites the previous character in the Rx FIFO with a new character,
losing the previous character. The channel then writes the new character to the buffer, closes it, sets
RxBD[OV], and generates an RX interrupt if not masked. In automatic multidrop mode, the receiver
enters hunt mode immediately.
CD Lost during
Character
Reception
If this error occurs and the channel is using this pin to automatically control reception, the channel
terminates character reception, closes the buffer, sets RxBD[CD], and generates the RX interrupt if
not masked. This error has the highest priority. The last character in the buffer is lost and other errors
are not checked. In automatic multidrop mode, the receiver enters the hunt mode immediately.
Parity
When a parity error occurs, the channel writes the received character to the buffer, closes the buffer,
sets RxBD[PR], and generates the RX interrupt if not masked. The channel also increments the
parity error counter PAREC. In automatic multidrop mode, the receiver enters hunt mode
immediately.
Noise
A noise error occurs when the three samples of a bit are not identical. When this error occurs, the
channel writes the received character to the buffer, proceeds normally, but increments the noise error
counter NOSEC. Note that this error does not occur in synchronous mode.
Idle Sequence
Receive
If the UART is receiving data and gets an idle character (all ones), the channel begins counting
consecutive idle characters received. If MAX_IDL is reached, the buffer is closed and an RX interrupt
is generated if not masked. If no buffer is open, this event does not generate an interrupt or any
status information. The internal idle counter (IDLC) is reset every time a character is received. To
disable the idle sequence function, clear MAX_IDL.
Framing
The UART reports a framing errors when it receives a character with no stop bit, regardless of the
mode. The channel writes the received character to the buffer, closes it, sets RxBD[FR], generates
the RX interrupt if not masked, increments FRMEC, but does not check parity for this character. In
automatic multidrop mode, the receiver immediately enters hunt mode. If the UART allows data with
no stop bits (PSMR[RZS] = 1) when in synchronous mode (PSMR[SYN] = 1), framing errors are
reported but reception continues assuming the unexpected zero is the start bit of the next character;
in this case, the user may ignore a reported framing error until multiple framing errors occur within a
short period.
Break Sequence When the rst break sequence is received, the UART increments the break error counter BRKEC. It
updates BRKLN when the sequence completes. After the rst 1 is received, the UART sets
SCCE[BRKE], which generates an interrupt if not masked. If the UART is receiving characters when
it receives a break, it closes the Rx buffer, sets RxBD[BR], and sets SCCE[RX], which can generate
an interrupt if not masked. If PSMR[RZS] = 1 when the UART is in synchronous mode, a break
sequence is detected after two successive break characters are received.
相關(guān)PDF資料
PDF描述
MPC866TCZP100 32-BIT, 100 MHz, RISC PROCESSOR, PBGA256
MPC866TZP133A 32-BIT, 133 MHz, RISC PROCESSOR, PBGA357
MPC866PZP133A 32-BIT, 133 MHz, RISC PROCESSOR, PBGA357
MPC9229EI 400 MHz, OTHER CLOCK GENERATOR, PQCC28
MPC9229FN 400 MHz, OTHER CLOCK GENERATOR, PQCC28
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MPC866PCZP100A 功能描述:微處理器 - MPU POWER QUICC I HIP6W RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
MPC866PVR100A 功能描述:微處理器 - MPU PQ I HIP6W NO-PB RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
MPC866PVR133A 功能描述:微處理器 - MPU PQ I HIP6W NO-PB RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
MPC866PZP100 制造商:Rochester Electronics LLC 功能描述:- Bulk
MPC866PZP100A 功能描述:微處理器 - MPU POWER QUICC I HIP6W RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
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