參數(shù)資料
型號： MPC866PCZP100
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 100 MHz, RISC PROCESSOR, PBGA256
封裝： 23 X 23 MM, PLASTIC, BGA-256
文件頁數(shù)： 61/1358頁
文件大?。?/td> 14179K
代理商： MPC866PCZP100
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40-4
MPC866 PowerQUICC Family User’s Manual
MOTOROLA
PRELIMINARY—SUBJECT TO CHANGE WITHOUT NOTICE
Interrupt Queue Entry
40.2 Interrupt Queue Entry
Each entry in the ATM interrupt queue contains event information for a specic ATM
channel. During initialization, the host software should clear all queue entries and set the
wrap bit (W) only for the last entry. The format of an interrupt queue entry is shown in
5
DCC
DPLL carrier sense status change. Indicates carrier sense status generated by the DPLL has
changed state. The value of the DCC bit is valid only when the DPLL is enabled.
6–10
—
Reserved
11
SYNC Cell synchronization changed status. Indicates that the receiver has lost or gained cell delineation.
The SYNC interrupt is signaled whenever the receiver changes lock status (refer to the ASTATUS
If synchronization is lost (lock bit is cleared), the SYNC interrupt indicates a fatal ATM reassembly
error because the affected channels are unknown. When this happens, the receiver stops receiving
data from all channels and all data transfers to memory halt. After re-initializing the channels, the
host may resume receiving cells by executing the RESTART RECEIVE command (see Section 38.7,
“ATM Commands”) for each channel.
12
IQOV
Interrupt queue overow. Set by the CP whenever an overow condition in the interrupt queue
occurs. This condition occurs if the CP attempts to write a new interrupt entry into a valid entry (V =
1) not yet handled by the host.
13
GINT
Global interrupt. Indicates that at least one new entry has been added to the interrupt queue. After
clearing the GINT event ag, the host begins processing the entries using the service pointer. The
host returns from the interrupt handler when it reaches an invalid queue entry (V = 0).
14
GUN
Global transmitter underrun. Indicates that an underrun occurred in the SCC transmitter FIFO. A
GUN error is fatal because the affected channels are unknown. After GUN is set, the transmitter
stops data transmission from all channels and sets the APC disabled status ag APCST[DIS]. The
transmit line enters an idle state (logic high). After re-initializing the channels, the host may resume
transmission by issuing a RESTART TRANSMIT command (see Section 38.7, “ATM Commands”) for
each channel.
For a faster recovery from a GUN error, re-initialize TSTATE by writing STFCR to the rst byte (MSB
of the 32 bit value representing xSTATE), clearing the second byte, and leaving the third and fourth
(LSB of the 32 bit value representing xSTATE) bytes as is. Then the APC can be restarted by clearing
APCST[DIS]. This procedure results in corrupted transmit frames initially. (TSTATE should normally
be modied only during system initialization.)
Note: Clearing APCST[DIS] may be overwritten by the APC scheduling process; therefore, the user
should verify that APCST[DIS] has indeed been cleared after a minimum of 50 system clocks.
15
GOV
Global receiver overrun. Indicates that an overrun occurred in the SCC receiver FIFO. A GOV error
is fatal because the affected channels are unknown. After GOV is set, the receiver stops receiving
data from all channels and halts all data transfers to memory. After re-initializing the channels the
host may resume receiving by issuing a RESTART RECEIVE command (see Section 38.7, “ATM
Commands”) for each channel.
For a faster recovery from a GOV error, re-initialize RSTATE by writing SRFCR to the rst byte (MSB
of the 32 bit value representing xSTATE), clearing the second byte, and leaving the third and fourth
(LSB of the 32 bit value representing xSTATE) bytes as is. This procedure initially results in corrupted
receive frames which should be disposed of by software. (RSTATE should normally be modied only
during system initialization.)
Table 40-2. Serial ATM Event Register (SCCE) Field Descriptions (continued)
Bits
Name
Description
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MPC866TCZP100 32-BIT, 100 MHz, RISC PROCESSOR, PBGA256
MPC866TZP133A 32-BIT, 133 MHz, RISC PROCESSOR, PBGA357
MPC866PZP133A 32-BIT, 133 MHz, RISC PROCESSOR, PBGA357
MPC9229EI 400 MHz, OTHER CLOCK GENERATOR, PQCC28
MPC9229FN 400 MHz, OTHER CLOCK GENERATOR, PQCC28
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MPC866PCZP100A 功能描述:微處理器 - MPU POWER QUICC I HIP6W RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
MPC866PVR100A 功能描述:微處理器 - MPU PQ I HIP6W NO-PB RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
MPC866PVR133A 功能描述:微處理器 - MPU PQ I HIP6W NO-PB RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
MPC866PZP100 制造商:Rochester Electronics LLC 功能描述:- Bulk
MPC866PZP100A 功能描述:微處理器 - MPU POWER QUICC I HIP6W RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
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