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參數(shù)資料
| 型號： | MSC8126VT8000 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 0-BIT, 500 MHz, OTHER DSP, PBGA431 |
| 封裝： | 20 X 20 MM, LEAD FREE, PLASTIC, FCBGA-431 |
| 文件頁數(shù)： | 30/48頁 |
| 文件大?。?/td> | 1138K |
| 代理商： | MSC8126VT8000 |
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MSC8126 Quad Digital Signal Processor Data Sheet, Rev. 15
Freescale Semiconductor
36
2.5.10.4
SMII Mode
2.5.11
GPIO Timing
Table 27. SMII Mode Signal Timing
No.
Characteristics
Min
Max
Unit
808
ETHSYNC_IN, ETHRXD to ETHCLOCK rising edge set-up time
1.0
—
ns
809
ETHCLOCK rising edge to ETHSYNC_IN, ETHRXD hold time
1.0
—
ns
810
ETHCLOCK rising edge to ETHSYNC, ETHTXD output delay
1.1 V core.
1.2 V core.
1.51
6.02
5.02
ns
Notes:
1.
Measured using a 5 pF load.
2.
Measured using a 15 pF load.
Figure 26. SMII Mode Signal Timing
Table 28. GPIO Timing
No.
Characteristics
Ref = CLKIN
Ref = CLKOUT
Unit
Min
Max
Min
Max
601
REFCLK edge to GPIO out valid (GPIO out delay time)
—
6.1
—
6.9
ns
602
REFCLK edge to GPIO out not valid (GPIO out hold time)
1.1
—
1.3
—
ns
603
REFCLK edge to high impedance on GPIO out
—
5.4
—
6.2
ns
604
GPIO in valid to REFCLK edge (GPIO in set-up time)
3.5
—
3.7
—
ns
605
REFCLK edge to GPIO in not valid (GPIO in hold time)
0.5
—
0.5
—
ns
Valid
ETHCLOCK
ETHSYNC_IN
ETHRXD
ETHSYNC
ETHTXD
Valid
810
809
808
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MSC8126TMP6400 | 0-BIT, 400 MHz, OTHER DSP, PBGA431 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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