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參數(shù)資料
| 型號： | MSM66573-XXTB |
| 廠商： | OKI ELECTRIC INDUSTRY CO LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MROM, 30 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | PLASTIC, TQFP-100 |
| 文件頁數(shù)： | 122/419頁 |
| 文件大小： | 2551K |
| 代理商： | MSM66573-XXTB |
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9-4
MSM66573 Family User's Manual
Chapter 9 Capture/Compare Timer
(2)
Free running counter control register (FRCON)
The free running counter control register (FRCON) consists of 6 bits. FRCON selects the
count clock for the free running counter (FRC), starts/stops the counter, and specifies the
operating mode of the capture/compare out module. Bits 0 to 2 (FRCK0 to FRCK2) select
the FRC count clock and bit 3 (FRRUN) specifies whether to run or stop the counter. Bit
4 (CP0MD) specifies the CPCM0 operating mode and bit 5 (CP1MD) specifies the CPCM1
operating mode.
FRCON can be read from and written to by the program. However, write operations are
invalid for the upper 2 bits. If read, a value of "1" will always be obtained for the upper 2 bits.
When reset (
RES signal input, execution of a BRK instruction, overflow of the watchdog
timer, opcode trap), FRCON becomes C0H, TBCCLK is selected for the FRC count clock,
and counting is halted. Also, the capture/compare out module will specify the compare out
mode.
Figure 9-3 shows the FRCON configuration.
Figure 9-3 FRCON Configuration
7
—
6
—
5
CP1MD
4
CP0MD
3
FRRUN
2
1
0
1
Halt FRC counting
Operate FRC counting
FRCK
21
FRC count clock
00
01
10
11
TBCCLK
1/2 TBCCLK
1/4 TBCCLK
1/8 TBCCLK
1/16 TBCCLK
1/32 TBCCLK
1/64 TBCCLK
1/128 TBCCLK
0
1
0
1
0
1
0
1
FRCK2 FRCK1 FRCK0
0
CP0MD
CPCM0 operating mode
1
Compare out mode
Capture mode
0
CP1MD
CPCM1 operating mode
1
Compare out mode
Capture mode
FRCON
At reset
11000000
Address:
R/W access:
0050 [H]
R/W
"—" indicates a nonexistent bit.
If read, its value will be "1."
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| MSM66577L-TB | 16-BIT, MROM, 14 MHz, MICROCONTROLLER, PQFP100 |
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參數(shù)描述 |
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