參數(shù)資料
型號(hào)： MSP430F249MPMEP
廠商： TEXAS INSTRUMENTS INC
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 16 MHz, RISC MICROCONTROLLER, PQFP64
封裝： GREEN, PLASTIC, QFP-64
文件頁(yè)數(shù)： 52/81頁(yè)
文件大小： 1133K
代理商： MSP430F249MPMEP
MSP430F249-EP
MIXED SIGNAL MICROCONTROLLER
2008
56
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
electrical characteristics over recommended ranges of supply voltage and operating free-air
temperature (unless otherwise noted) (continued)
12-bit ADC, built-in reference
PARAMETER
TEST CONDITIONS
TA
VCC
MIN
TYP
MAX
UNIT
REF2_5V = 1 (2.5 V),
55°C to 105°C
3 V
2.4
2.5
2.6
V
Positive built-in
reference voltage
REF2_5V = 1 (2.5 V),
IVREF+max ≤ IVREF+≤ IVREF+min
125°C
3 V
2.37
2.5
2.64
V
VREF+
reference voltage
output
REF2_5V = 0 (1.5 V),
55°C to 105°C
2.2 V/3 V
1.44
1.5
1.56
V
output
REF2_5V = 0 (1.5 V),
IVREF+max ≤ IVREF+≤ IVREF+min
125°C
2.2V / 3 V
1.42
1.5
1.57
AVCC minimum
REF2_5V = 0,
IVREF+max ≤ IVREF+≤ IVREF+min
2.2
AVCC(min)
AVCC minimum
voltage, Positive
built-in reference
REF2_5V = 1,
0.5mA ≤ IVREF+≤ IVREF+min
2.8
V
built in reference
active
REF2_5V = 1,
1mA ≤ IVREF+≤ IVREF+min
2.9
I
Load current out of
2.2 V
0.01
0.5
mA
IVREF+
Load current out of
VREF+ terminal
3 V
0.01
1
mA
IVREF+ = 500 μA ± 100 μA
Analog input voltage 0 75 V;
2.2 V
±2
I
Load-current
regulation V
Analog input voltage ~0.75 V;
REF2_5V = 0
3 V
±2
LSB
IL(VREF)+
regulation VREF+
terminal
IVREF+ = 500 μA ± 100 μA,
Analog input voltage ~1.25 V,
REF2_5V = 1
3 V
±2
LSB
I
Load current
regulation V
IVREF+ =100 μA → 900 μA,
C
5 μF ax 0 5 × V
3 V
20
ns
IDL(VREF) +
regulation VREF+
terminal
CVREF+=5 μF, ax ~0.5 × VREF+
Error of conversion result ≤ 1 LSB
3 V
20
ns
CVREF+
Capacitance at pin
VREF+ (see Note 1)
REFON =1,
0 mA ≤ IVREF+ ≤ IVREF+max
2.2 V/3 V
5
10
μF
TREF+
Temperature
coefficient of built-in
reference
IVREF+ is a constant in the range
of 0 mA ≤ IVREF+ ≤ 1 mA
2.2 V/3 V
±100 ppm/°C
tREFON
Settle time of
internal reference
voltage (see
Figure 38 and Note
2)
IVREF+ = 0.5 mA, CVREF+ = 10 μF,
VREF+ = 1.5 V, VAVCC = 2.2 V
17
ms
Not production tested, limits characterized
Not production tested, limits verified by design
NOTES: 1. The internal buffer operational amplifier and the accuracy specifications require an external capacitor. All INL and DNL tests uses
two capacitors between pins VREF+ and AVSS and VREF/VeREF and AVSS: 10-μF tantalum and 100-nF ceramic.
2. The condition is that the error in a conversion started after tREFON is less than ±0.5 LSB. The settling time depends on the external
capacitive load.
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