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參數資料
| 型號： | PEF20542 |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | 2 Channel Serial Optimized Communication Controller with DMA |
| 中文描述： | 2通道串行通信控制器的優(yōu)化與DMA |
| 文件頁數： | 102/300頁 |
| 文件大?。?/td> | 3878K |
| 代理商： | PEF20542 |
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PEB 20542
PEF 20542
Detailed Protocol Description
Data Sheet
102
2000-09-14
Additionally, the CTS signal may be used to control data transmission.
4.4.4
Special Functions
4.4.4.1
Break Detection/Generation
Break generation:
On issuing the transmit break command (bit
’
XBRK
’
in register
CCR3L
), the TxD pin is
‘
0
’
level with the next following transmit clock edge, and
released with the first transmit clock edge after this command is reset again by software.
Break detection:
The SCC recognizes the break condition upon receiving consecutive (physical)
‘
0
’
s for
the defined character length, the optional parity and the selected number of stop bits
(
‘
zero
’
character and framing error). The
‘
zero
’
character is not pushed to RFIFO. If
enabled, the
’
Break
’
interrupt (BRK) is generated.
The break condition will be present until a
‘
1
’
is received which is indicated by the
‘
Break
Terminated
’
interrupt (BRKT).
4.4.4.2
In-band Flow Control by XON/XOFF Characters
Programmable XON and XOFF characters:
The
XON
/
XOFF
registers contain the programmable values for XON and XOFF
characters. The number of significant bits in a register is determined by the programmed
character length via bit field
’
CHL
’
in register
CCR3L
.
Additionally, two programmable eight-bit values in registers
MXON
and
MXOFF
serve
as masks for the characters XON and XOFF, respectively:
A
‘
1
’
in any mask bit position has the effect that no comparison is performed between the
corresponding bits in the received characters (
‘
don
’
t cares
’
) and the XON/XOFF value.
At RESET, the masks are zero
’
ed, i.e. all bit positions will be compared.
A received character is considered to be recognized as a valid XON or XOFF character
–
if it is correctly framed (correct length),
–
if its bits match the ones in the
XON
or
XOFF
registers over the programmed character
length,
–
if it has correct parity (if applicable).
Received XON and XOFF characters are stored in the SCC receive FIFO, as any other
characters, when bit
’
DXS
’
is set to
’
0
’
in register
CCR3L
. Otherwise they are not stored
in the receive FIFO.
相關PDF資料 |
PDF描述 |
|---|---|
| PEB20542 | 2 Channel Serial Optimized Communication Controller with DMA |
| PEF20550 | ICs for Communications |
| PEB20550 | ICs for Communications |
| PEF20570 | DSP Embedded Line and Port Interface Controller |
| PEF20571 | DSP Embedded Line and Port Interface Controller |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| PEF20542FV13XP | 制造商:Lantiq 功能描述:Communication Controller 144-Pin TQFP |
| PEF2054-N | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:PCM， Other/Special/Miscellaneous |
| PEF2054NV1.0 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| PEF2054NV1.0EPICS | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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