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參數(shù)資料
| 型號： | PEF20542 |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | 2 Channel Serial Optimized Communication Controller with DMA |
| 中文描述： | 2通道串行通信控制器的優(yōu)化與DMA |
| 文件頁數(shù)： | 57/300頁 |
| 文件大?。?/td> | 3878K |
| 代理商： | PEF20542 |
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PEB 20542
PEF 20542
Functional Overview
Data Sheet
57
2000-09-14
3.2.3.6
Clock Mode 5a (Time Slot Mode)
This operation mode has been designed for application in time-slot oriented PCM
systems.
Note: For correct operation NRZ data coding/encoding should be used.
The receive and transmit clock are common for each channel and must be supplied
externally via pin RxCLK. The SCC receives and transmits only during fixed time-slots.
Either one time-slot
–
of programmable width (1
…
512 bit, via TTSA and RTSA registers), and
–
of programmable location with respect to the frame synchronization signal (via pin
FSC)
or up to 32 time-slots
–
of constant width (8 bits), and
–
of programmable location with respect to the frame synchronization signal (via pin
FSC)
can be selected.
The time-slot locations can be programmed independently for receive and transmit
direction via TTSA/RTSA and PCMTX/PCMRX registers.
Depending on the value programmed via those registers, the receive/transmit time-slot
starts with a delay of 1 (minimum delay) up to 1024 clock periods following the frame
synchronization signal.
Figure 18
shows how to select a time-slot of programmable width and location and
Figure 19
shows how to select one or more time-slots of 8-bit width.
If bit
’
TOE
’
in register
CCR0L
is set, the selected transmit time-slot(s) is(are) indicated at
an output status signal via pin TxCLK, which is driven to
‘
low
’
during the active transmit
window.
Bit
’
TSCM
’
in register
CCR1H
determines whether the internal offset counters are
continuously running even if no synchronization pulse is detected at FSC signal or
stopping at their maximum value.
In the continuous case the repetition rate of offset counter operation is 1024 transmit or
receive clocks respectively. An FSC pulse detected earlier resets the counters and starts
operation again.
In the non-continuous case the time slot assigner offset counter is stopped after the
counter reached its maximum value and is started again if an FSC pulse is detected.
相關PDF資料 |
PDF描述 |
|---|---|
| PEB20542 | 2 Channel Serial Optimized Communication Controller with DMA |
| PEF20550 | ICs for Communications |
| PEB20550 | ICs for Communications |
| PEF20570 | DSP Embedded Line and Port Interface Controller |
| PEF20571 | DSP Embedded Line and Port Interface Controller |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| PEF20542FV1.3 | 功能描述:網(wǎng)絡控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| PEF20542FV13XP | 制造商:Lantiq 功能描述:Communication Controller 144-Pin TQFP |
| PEF2054-N | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:PCM， Other/Special/Miscellaneous |
| PEF2054NV1.0 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| PEF2054NV1.0EPICS | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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