Indirect addr" />
參數(shù)資料
型號(hào): PIC16F688-I/SL
廠商: Microchip Technology
文件頁數(shù): 2/204頁
文件大?。?/td> 0K
描述: IC PIC MCU FLASH 4KX14 14SOIC
產(chǎn)品培訓(xùn)模塊: Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標(biāo)準(zhǔn)包裝: 57
系列: PIC® 16F
核心處理器: PIC
芯體尺寸: 8-位
速度: 20MHz
連通性: UART/USART
外圍設(shè)備: 欠壓檢測/復(fù)位,POR,WDT
輸入/輸出數(shù): 12
程序存儲(chǔ)器容量: 7KB(4K x 14)
程序存儲(chǔ)器類型: 閃存
EEPROM 大?。?/td> 256 x 8
RAM 容量: 256 x 8
電壓 - 電源 (Vcc/Vdd): 2 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器: A/D 8x10b
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 85°C
封裝/外殼: 14-SOIC(0.154",3.90mm 寬)
包裝: 管件
產(chǎn)品目錄頁面: 639 (CN2011-ZH PDF)
配用: XLT14SO-1-ND - SOCKET TRANSITION 14SOIC 150/208
AC162061-ND - HEADER INTRFC MPLAB ICD2 20PIN
AC162056-ND - HEADER INTERFACE ICD2 16F688
第1頁當(dāng)前第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁
PIC16F688
DS41203E-page 8
2009 Microchip Technology Inc.
FIGURE 2-2:
PIC16F688 SPECIAL FUNCTION REGISTERS
File
Address
Indirect addr. (1) 00h
Indirect addr. (1) 80h
Indirect addr. (1) 100h
Indirect addr. (1) 180h
TMR0
01h
OPTION_REG
81h
TMR0
101h
OPTION_REG
181h
PCL
02h
PCL
82h
PCL
102h
PCL
182h
STATUS
03h
STATUS
83h
STATUS
103h
STATUS
183h
FSR
04h
FSR
84h
FSR
104h
FSR
184h
PORTA
05h
TRISA
85h
PORTA
105h
TRISA
185h
06h
86h
106h
186h
PORTC
07h
TRISC
87h
PORTC
107h
TRISC
187h
08h
88h
108h
188h
09h
89h
109h
189h
PCLATH
0Ah
PCLATH
8Ah
PCLATH
10Ah
PCLATH
18Ah
INTCON
0Bh
INTCON
8Bh
INTCON
10Bh
INTCON
18Bh
PIR1
0Ch
PIE1
8Ch
10Ch
18Ch
0Dh
8Dh
10Dh
18Dh
TMR1L
0Eh
PCON
8Eh
10Eh
18Eh
TMR1H
0Fh
OSCCON
8Fh
10Fh
18Fh
T1CON
10h
OSCTUNE
90h
110h
190h
BAUDCTL
11h
ANSEL
91h
111h
191h
SPBRGH
12h
92h
112h
192h
SPBRG
13h
93h
113h
193h
RCREG
14h
94h
114h
194h
TXREG
15h
WPUA
95h
115h
195h
TXSTA
16h
IOCA
96h
116h
196h
RCSTA
17h
EEDATH
97h
117h
197h
WDTCON
18h
EEADRH
98h
118h
198h
CMCON0
19h
VRCON
99h
119h
199h
CMCON1
1Ah
EEDAT
9Ah
11Ah
19Ah
1Bh
EEADR
9Bh
11Bh
19Bh
1Ch
EECON1
9Ch
11Ch
19Ch
1Dh
EECON2(1)
9Dh
11Dh
19Dh
ADRESH
1Eh
ADRESL
9Eh
11Eh
19Eh
ADCON0
1Fh
ADCON1
9Fh
11Fh
19Fh
General
Purpose
Register
96 Bytes
20h
General
Purpose
Register
80 Bytes
A0h
General
Purpose
Register
80 Bytes
120h
1A0h
EFh
16Fh
1EFh
accesses
Bank 0
F0h
accesses
Bank 0
170h
accesses
Bank 0
1F0h
7Fh
FFh
17Fh
1FFh
Bank 0Bank 1Bank 2Bank 3
Unimplemented data memory locations, read as ‘0’.
Note 1:
Not a physical register.
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