參數(shù)資料
型號(hào)： PIC16LC782T-I/SS
廠商： Microchip Technology
文件頁數(shù)： 161/186頁
文件大?。?/td> 0K
描述： IC MCU OTP 2KX14 A/D D/A 20SSOP
標(biāo)準(zhǔn)包裝： 1,600
系列： PIC® 16C
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 13
程序存儲(chǔ)器容量： 3.5KB（2K x 14）
程序存儲(chǔ)器類型： OTP
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x8b; D/A 1x8b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-SSOP（0.209"，5.30mm 寬）
包裝： 帶卷 (TR)
其它名稱： PIC16LC782TI/SS
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PIC16C781/782
DS41171A-page 74
Preliminary
2001 Microchip Technology Inc.
FIGURE 9-2:
ANALOG INPUT MODEL
9.4
ADC Configuration and
Conversion
Example 9-2 demonstrates an ADC conversion. The
RA0/AN0 pin is configured as the analog input. The ref-
erence voltage selected is the device AVDD. The ADC
interrupt is enabled, and the ADC conversion clock is
ADRC.
Clearing the GO/DONE bit during a conversion aborts
the current conversion. The ADRES register is NOT
updated with the partially completed ADC conversion
sample. That is, the ADRES register continues to con-
tain the value of the last completed conversion (or the
last value written to the ADRES register). After the ADC
conversion is aborted, a 2TAD wait period is required
before the next acquisition is started. After this 2TAD
wait period, an acquisition is automatically started on
the selected channel.
EXAMPLE 9-2:
ADC CONVERSION
;********************************************
;*
This code block will configure the ADC
;*
for polling, AVDD as reference, RC clock
;*
and RA0 input.
;*
Conversion start & wait for complete
;*
polling code included.
;*
BANKSEL
ADCON1
;
Select Bank 1
CLRF
ADCON1
; AVDD as VREF
BSF
TRISA,0
; Set RA0 as input
BSF
ANSEL,0
; Set RA0 as analog
BANKSEL
ADCON0
; Select Bank0
MOVLW
B’11000001’
MOVWF
ADCON0
; RC, Ch 0, ADC on
;********************************************
;*
Start & Wait for ADC complete, assumes
;*
minimum acquisition delay from
;*
configuration.
ADC_CNVRT
BANKSEL
ADCON0
; Select Bank 0
BSF
ADCON0,GO
; Start convert
ADC_CN_LOOP
BTFSC
ADCON0,GO
; Test for end
GOTO
ADC_CN_LOOP ; If not, wait
MOVF
ADRES,W
; Get result
CPIN
VA
RS
ANx
5 pF
VDD
VT = 0.6V
ILEAKAGE
RIC
≤ 1k
Sampling
Switch
SS
RSS
CHOLD
= DAC capacitance
VSS
6V
Sampling Switch
5V
4V
3V
2V
567 8 9 10 11
( k
)
VDD
= 51.2 pF
± 500 nA
Legend: CPIN
VT
ILEAKAGE
RIC
SS
CHOLD
= input capacitance
= threshold voltage
= leakage current at the pin due to
= interconnect resistance
= sampling switch
= sample/hold capacitance (from DAC)
various junctions
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