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參數(shù)資料
| 型號： | PM7366-PI |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | FRAME ENGINE AND DATA LINK MANAGER |
| 中文描述： | 8 CHANNEL(S), 64K bps, SERIAL COMM CONTROLLER, PBGA272 |
| 封裝： | 27 X 27 MM, 2.33 MM HEIGHT, PLASTIC, BGA-272 |
| 文件頁數(shù)： | 125/286頁 |
| 文件大?。?/td> | 2243K |
| 代理商： | PM7366-PI |
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RELEASED
DATA SHEET
PM7366 FREEDM-8
ISSUE 4
PMC-1970930
FRAME ENGINE AND DATA LINK MANAGER
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA,INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
112
low, receive link #n is unchannelised. The E1 register bit is ignored. RCLK[n] is gapped
during non-data bytes. The choice between treating all data bits as a contiguous stream with
arbitrary byte alignment or byte aligned to gaps in RCLK[n] is controlled by the BSYNC bit.
E1:
The E1 frame structure select bit (E1) configures the corresponding receive link for
channelised E1 operation when CEN is set high. RCLK[n] is held quiescent during the FAS
and NFAS framing bytes. The data bit on RD[n] associated with the first rising edge of
RCLK[n] after an extended quiescent period is considered to be the most significant bit of
time-slot 1. Link data is present at time-slots 1 to 31. When E1 is set low and CEN is set
high, the corresponding receive link is configured for channelised T1 operation. RCLK[n] is
held quiescent during the framing bit. The data bit on RD[n] associated with the first rising
edge of RCLK[n] after an extended quiescent period is considered to be the most significant
bit of time-slot 1. Link data is present at time-slots 1 to 24. E1 is ignored when CEN is set
low.
BSYNC:
The byte synchronisation enable bit (BSYNC) controls the interpretation of gaps in RCLK[n]
when the corresponding link is in unchannelised mode (CEN set low). When BSYNC is set
high, the data bit on RD[n] clocked in by the first rising edge of RCLK[n] after an extended
quiescent period is considered to be the most significant bit of a data byte. When BSYNC is
set low, gaps in RCLK[n] carry no special significance. BSYNC is ignore when CEN is set
high.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM7367-PI | DIODE 1N4002 RECTIFYING |
| PM7367 | 32 link, 32 Channel Data Link Manager with PCI Interface |
| PM7375 | ATM SAR and PHY Processor for PCI Bus |
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| PM7380 | FRAME ENGINE AND DATA LINK MANAGER 32P672 |
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參數(shù)描述 |
|---|---|
| PM7367 | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM7367-PI | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM-737 | 制造商:Eclipse Tools 功能描述: |
| PM7375 | 制造商:PMC 制造商全稱:PMC 功能描述:LOCAL ATM SAR & PHYSICAL LAYER |
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