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參數(shù)資料
| 型號(hào)： | PM7382 |
| 廠商： | PMC-Sierra, Inc. |
| 英文描述： | Frame Engine and Data Link Manager 32P256 |
| 中文描述： | 幀引擎和數(shù)據(jù)鏈路管理32P256 |
| 文件頁(yè)數(shù)： | 63/330頁(yè) |
| 文件大?。?/td> | 2508K |
| 代理商： | PM7382 |
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RELEASED
DATA SHEET
PM7382 FREEDM-32P256
ISSUE 3
PMC-2010333
FRAME ENGINE AND DATA LINK MANAGER 32P256
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA,INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
52
Although a STATUS+RPDR only totals to 17 bits, each queue entry is a dword,
i.e. 32 bits. When the RMAC256 block writes a STATUS+RPDR to the ready
queue, it sets the remaining 7 bits in the third byte to zero and the fourth byte is
unmodified.
Figure 8 – RPDRR Queue Operation
Rx Packet Descriptor Reference Ready Queue
Bit 0
Bit 31
RPDRRQ_START_ADDR
RPDRRQ_END_ADDR
RPDRRQ_READ_ADDR
RPDRRQ_WRITE_ADDR
RPD - 16 bytes
RPD - 16 bytes
RPD - 16 bytes
RPD - 16 bytes
RPD - 16 bytes
buffer
-packet M
buffer
-packet N
buffer
-start of
packet O
buffer
-middle of
packet O
buffer
-end of
packet O
STATUS+RPDR
STATUS+RPDR
STATUS+RPDR
Receive Channel Descriptor Reference Table
On a per-channel basis, the RMAC256 caches information such as the current
DMA information in a Receive Channel Descriptor Reference (RCDR) Table.
The RMAC256 can process 256 channels and stores three dwords of
information per channel. This information is cached internally in order to
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM7383 | FRAME ENGINE AND DATA LINK MANAGER 32A256 |
| PM7383-PI | FRAME ENGINE AND DATA LINK MANAGER 32A256 |
| PM7384 | Frame Engine and Data Link Manager |
| PM7384-BI | FRAME ENGINE AND DATA LINK MANAGER 84P672 |
| PM7385 | Frame Engine and Data Link Manager |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM7382-PI | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER 32P256 |
| PM7383 | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER 32A256 |
| PM7383-PI | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER 32A256 |
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