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參數(shù)資料
| 型號： | PSB21911 |
| 廠商： | SIEMENS A G |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | ISDN Echocancellation Circuit for Terminal Applications IEC-Q TE |
| 中文描述： | DATACOM, ISDN ECHO CANCELLER |
| 文件頁數(shù)： | 39/164頁 |
| 文件大小： | 1401K |
| 代理商： | PSB21911 |
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PSB 21911
PSF 21911
Microprocessor Interface
Semiconductor Group
39
11.97
2.4
Microprocessor Interface
The parallel/serial microprocessor interface can be selected to be either of the
1.
Siemens/Intel non-multiplexed
bus type with control signals
CS, WR, RD
2.
Motorola
type with control signals
CS, R/W, DS
3.
Siemens/Intel multiplexed
address/data bus type with control
signals
CS, WR, RD, ALE
4.
Serial mode
using control signals
CDIN, CDOUT, CCLK and CS
.
The selection is performed via pins ALE/CCLK and SMODE as follows:
The occurrence of an edge on ALE/CCLK, either positive or negative, at any time during
the operation immediately selects interface type 3 or 4. A return to one of the other
interface types is possible only if a hardware reset is issued.
2.4.1
Microprocessor Clock Output
The microprocessor clock is provided in μP mode on the MCLK-output. Four clock rates
are provided by a programmable prescaler. These are 7.68 MHz, 3.84 MHz, 1.92 MHz
and 0.96 MHz. Switching between the clock rates is realized without spikes. The
oscillator remains active all the time. The clock is synchronized to the 15.36 MHz clock
at the XIN pin.
2.4.2
The watchdog is enabled by setting the SWST:WT bit to “1”. The value of SWST:WT
after hardware reset (pin RES low and pin TSP low) is "0".
After the microcontroller has enabled the watchdog timer it has to write the bit patterns
“10” and “01” in ADF:WTC1 and ADF:WTC2 within a period of 132 ms. If it fails to do so,
a reset signal of 5 ms at pin RST is generated. The clock at pin MCLK remains active
during this reset.
Watchdog Timer
Table 5
Microprocessor Interface Modes
ALE
0
1
edge
edge
SMODE
x
x
0
1
Siemens/Intel non-Mux
Motorola
Siemens/Intel Mux
Serial
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PDF描述 |
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