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參數(shù)資料
| 型號(hào)： | PXB4340E |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | ICs for Communications |
| 中文描述： | 通信集成電路 |
| 文件頁(yè)數(shù)： | 14/66頁(yè) |
| 文件大小： | 869K |
| 代理商： | PXB4340E |
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3;%)
Data Sheet
1-14
07.2000
3LQ'HILQLWLRQVDQG)XQFWLRQV
The following explanations apply to all pins within a field in the following table:
Pins with a
1)
attached are connected with an internal pull up resistor.
3LQ'HILQLWLRQVDQG)XQFWLRQV
3LQ1R
6\PERO
,QSXW,
2XWSXW2
)XQFWLRQ
*HQHUDOSLQV
20
RES
I
Hardware reset signal
Active low
Clock input of bus interface
54
CLK
I
'DWDDQG$GGUHVV%XV,QWHUIDFHEHWZHHQ&$0(DQG$/3SLQV
99, 97, 95, 93, 91,
89, 87, 85, 83, 81,
77, 76, 74, 72, 70,
68, 66, 64, 62, 60,
58, 56, 52, 50, 48,
46, 44, 42, 40, 38,
36, 34, 32
18, 16, 14, 12
DAT
(32:0)
I/O
Data bus of bus interface
including parity bit
(DAT(0)).
ADR
(3:0)
I
Address bus of the bus interface
26
CS
I
Chip enable signal of the bus interface.
Active low
24
OE
I
Output enable signal of the bus interface.
Active low
22
WE
I
Write enable signal of the bus interface.
Active low
106
EN16
I
16-Bit mode enable signal of the bus
interface.
If 0, then DAT(16:0) are used.
If 1, then DAT(32:0) are used.
With ALP, this pin should be 0 for use with the
16-bit data bus.
&$0(&DVFDGH,QWHUIDFHSLQV
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PXB4360F | ICs for Communications |
| PXB4350E | ICs for Communications |
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| PXF4222E | Interworking Controller Next Generation |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| PXB4350E | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:ICs for Communications |
| PXB4360F | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:ICs for Communications |
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