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參數(shù)資料
| 型號(hào)： | RK80530KZ006512 |
| 英文描述： | MICROPROCESSOR|32-BIT|CMOS|PGA|370PIN|CERAMIC |
| 中文描述： | 微處理器| 32位|的CMOS |美巡賽| 370PIN |陶瓷 |
| 文件頁數(shù)： | 26/86頁 |
| 文件大?。?/td> | 882K |
| 代理商： | RK80530KZ006512 |
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26
Datasheet
Intel
Pentium
III Processor with 512KB L2 Cache at 1.13GHz to 1.40GHz
9. Based on simulation and averaged over the duration of any change in current. Use to compute the maximum
inductance tolerable and reaction time of the voltage regulator. This parameter is not tested.
10.dIcc/dt specifications are measured and specified at the PGA370 socket pins.
11.Static voltage regulation includes: DC output initial voltage set point adjust, Output ripple and noise, Output
load ranges specified in the tables above. See
VRM 8.5 DC-Dc Converter Design Guidelines
.
12.Pull ups only.
Table 8
contains typical slew rate data for the Intel Pentium
III
processor with 512KB L2
Cache. Actual slew rate values and wave-shapes may vary slightly depending on the type and size
of decoupling capacitors used in a particular implementation.
Table 8.
Power Supply Current Slew Rate (dIcc
core
/dt)
Slew Rate – 26A Load Step
Slew Rate (26A) – ICC @ socket
0
5
10
15
20
25
30
0
1
2
3
4
5
6
I
PWL Slew Rate Data
Time (uS) Icc @ socket (A)
0.1
0.15
0.5
1
1.5
2
2.5
3
3.5
4
4.5
26.23
23.18
20.03
21.10
21.88
22.29
22.30
22.07
21.78
21.58
21.51
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PDF描述 |
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