參數(shù)資料
型號(hào)： SAK-TC1762-128F80HL
廠商： INFINEON TECHNOLOGIES AG
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 80 MHz, MICROCONTROLLER, PQFP176
封裝： PLASTIC, LQFP-176
文件頁數(shù)： 12/114頁
文件大?。?/td> 852K
代理商： SAK-TC1762-128F80HL
TC1762
Electrical Parameters
Preliminary
Data Sheet
105
V1.0, 2008-04
4.3.8.3
Synchronous Serial Channel (SSC) Master Mode Timing
Table 4-19 provides the characteristics of the SSC timing in the TC1762.
Figure 4-19
SSC Master Mode Timing
Table 4-19
SSC Master Mode Timing (Operating Conditions apply, CL = 50 pF)
Parameter
Symbol
Limit Values
Unit
Min.
Max.
SCLK clock period
1)2)
1) SCLK signal rise/fall times are the same as the A2 Pads rise/fall times.
2) SCLK signal high and low times can be minimum 1
× T
SSC.
t
50
CC 2
× T
SSC
3)
T
SSCmin = TSYS = 1/fSYS. When fSYS = 80 MHz, t50 = 25ns
–ns
MTSR/SLSOx delay from SCLK
t
51
CC 0
8
ns
MRST setup to SCLK
t
52
SR 10
–
ns
MRST hold from SCLK
t
53
SR 5
–
ns
SSC_Tmg_1.vsd
SCLK1)2)
MTSR1)
t
51
t
51
MRST1)
t
53
Data
valid
t
52
SLSOx2)
t
51
1) This timing is based on the following setup: CON.PH = CON.PO = 0.
2) The transition at SLSOx is based on the following setup: SSOTC.TRAIL = 0
and the first SCLK high pulse is in the first one of a transmission.
t
50
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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