參數(shù)資料
型號(hào): SI5351B-A-GT
廠商: Silicon Laboratories Inc
文件頁數(shù): 57/72頁
文件大?。?/td> 0K
描述: IC CLK GEN PLL BLANK CUST 10MSOP
標(biāo)準(zhǔn)包裝: 50
系列: MultiSynth™
類型: *
PLL:
輸入: 晶體
輸出: CMOS
電路數(shù): 1
比率 - 輸入:輸出: 1:8
差分 - 輸入:輸出: 無/無
頻率 - 最大: 133MHz
除法器/乘法器: 是/無
電源電壓: 2.25 V ~ 3.63 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 10-TFSOP,10-MSOP(0.118",3.00mm 寬)
供應(yīng)商設(shè)備封裝: 10-MSOP
包裝: 管件
Si5351A/B/C
60
Preliminary Rev. 0.95
Reset value = 0000 0000
Register 168. CLK3 Initial Phase Offset
Bit
D7D6D5D4D3D2D1D0
Name
CLK3_PHOFF[6:0]
Type
R/W
Bit
Name
Function
7
Reserved
Only write 0 to this bit.
6:0
CLK3_PHOFF[6:0] Clock 3 Initial Phase Offset.
CLK3_PHOFF[6:0] is an unsigned integer with one LSB equivalent to a time delay of
Tvco/4, where Tvco is the period of the VCO/PLL associated with this output.
Register 169. CLK4 Initial Phase Offset
Bit
D7D6D5D4D3D2D1D0
Name
CLK4_PHOFF[6:0]
Type
R/W
Bit
Name
Function
7
Reserved
Only write 0 to this bit.
6:0
CLK4_PHOFF[6:0] Clock 4 Initial Phase Offset.
CLK4_PHOFF[6:0] is an unsigned integer with one LSB equivalent to a time delay of
Tvco/4, where Tvco is the period of the VCO/PLL associated with this output.
Register 170. CLK5 Initial Phase Offset
Bit
D7D6D5D4D3D2D1D0
Name
CLK5_PHOFF[6:0]
Type
R/W
Bit
Name
Function
7
Reserved
Only write 0 to this bit.
6:0
CLK5_PHOFF[6:0] Clock 5 Initial Phase Offset.
CLK5_PHOFF[6:0] is an unsigned integer with one LSB equivalent to a time delay of
Tvco/4, where Tvco is the period of the VCO/PLL associated with this output.
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Si5351B-Axxxxx-GU 功能描述:時(shí)鐘發(fā)生器及支持產(chǎn)品 Any-Rate, Dual PLL 133MHz Clock with VCXO and I2C, 8 outputs, 24-QSOP (customized) RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56
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