參數(shù)資料
型號： SPAKD56366PV120
廠商： MOTOROLA INC
元件分類： 數(shù)字信號處理
英文描述： 24-BIT, 120 MHz, OTHER DSP, PQFP144
封裝： TQFP-144
文件頁數(shù)： 1/147頁
文件大小： 2156K
代理商： SPAKD56366PV120
MOTOROLA
SEMICONDUCTOR ADVANCE INFORMATION
DSP56366
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DSP56366/D
Rev 1.3 12/01
2000, 2001 MOTOROLA, INC.
Advance Infomation
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Advance Information
24-Bit Audio Digital Signal Processor
The DSP56366 supports digital audio applications requiring sound field processing, acoustic equalization,
and other digital audio algorithms. The DSP56366 uses the high performance, single-clock-per-cycle
DSP56300 core family of programmable CMOS digital signal processors (DSPs) combined with the audio
signal processing capability of the Motorola Symphony DSP family, as shown in Figure 1. This design
provides a two-fold performance increase over Motorola’s popular Symphony family of DSPs while
retaining code compatibility. Significant architectural enhancements include a barrel shifter, 24-bit
addressing, instruction cache, and direct memory access (DMA). The DSP56366 offers 120 million
instructions per second (MIPS) using an internal 120 MHz clock at 3.3 V.
Figure 1 DSP56366 Block Diagram
CLOCK
GENERATOR
INTERNAL
DATA
BUS
EXTAL
PROGRAM
RAM
/INSTR.
CACHE
3K x 24
PROGRAM
ROM
40K x 24
Bootstrap ROM
PROGRAM
INTERRUPT
CONTROLLER
PROGRAM
DECODE
CONTROLLE
PROGRAM
ADDRESS
GENERATOR
YAB
XAB
PAB
YDB
XDB
PDB
GDB
MODA/IRQA
MODB/IRQB
DATA ALU
24X24+56->56-BIT MAC
TWO 56-BIT ACCUMULATORS
BARREL SHIFTER
MODC/IRQC
PLL
OnCE
HOST
INTER-
FACE
DAX
(SPDIF Tx.)
INTER-
FACE
4
16
X MEMORY
RAM
13K X 24
ROM
32K x 24
Y MEMORY
RAM
7K X 24
ROM
8K x 24
DDB
DAB
SIX CHANNELS
DMA UNIT
MEMORY EXPANSION AREA
PERIPHERAL
YM
_E
B
XM_
E
B
PM_EB
PI
O_E
B
24 BITS BUS
EXPANSION AREA
JTAG
4
5
RESET
POWER
MNGMNT
PINIT/NMI
2
TRIPLE
TIMER
1
MODD/IRQD
DRAM &
SRAM BUS
INTERFACE
&
I - CACHE
EXTERNAL
ADDRESS
BUS
SWITCH
EXTERNAL
DATA BUS
SWITCH
ADDRESS
10
DATA
CONTROL
24
18
ESAI
INTER-
FACE
8
6
ESAI_1
ADDRESS
GENERATION
UNIT
24-BIT
DSP56300
Core
SHI
INTER-
FACE
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PDF描述
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