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參數(shù)資料
| 型號(hào)： | SZA1000H |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類(lèi)： | 消費(fèi)家電 |
| 英文描述： | QIC digital equalizer |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP64 |
| 文件頁(yè)數(shù)： | 25/32頁(yè) |
| 文件大?。?/td> | 164K |
| 代理商： | SZA1000H |
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1998 Feb 16
25
Philips Semiconductors
Product specification
QIC digital equalizer
SZA1000
Notes
1.
2.
3.
4.
Pins 3, 4, 6, 9 to 20, 22, 23, 24, 30 and 31.
Measured at pins 39 and 44 with a 10 M
/15 pF load.
Measured at pins 40 and 43.
Differential pins 40 and 43.
5.
6.
C
o(L)(SRD)
is the external load (pF), at SRD (pin 27) for C
o(L)(SRD)
< 50 pF.
C
o(L)(RRC)
is the external load (pF), at RRC (pin 25) for C
o(L)(RRC)
< 50 pF.
C
o(L)(PACLK)
is the external load (pF), at PACLK (pin 29) for C
o(L)(PACLK)
< 50 pF.
C
o(L)(AUX)
is the external load (pF), at AUX0 to AUX7 (pins 11 to 18) for C
o(L)(AUX)
< 50 pF.
C
o(L)(WDOUT)
is the external load (pF), at WDOUT (pin 11) for C
o(L)(WDOUT)
< 50 pF.
7.
8.
9.
Write equalization section
f
clk(WEQ)
WEQ clock frequency
N2 = 1 or N3 = 1;
see Table 14
N6 =1;
see Table 14
36
MHz
24
24
MHz
t
WEQL
t
WEQH
t
su(WD-WEQCLK)
WEQ LOW time
WEQ HIGH time
setup time:
WDIN-to-WEQCLK
hold time: WD-to-WEQCLK
10
10
5
ns
ns
ns
N2 = 1 or N3 = 1;
see Table 14
N2 = 1 or N3 = 1;
see Table 14
WDI_I = 0;
see Table 15
note 9
t
h(WD-WEQCLK)
10
ns
t
IL(WDIN)
WDIN input LOW time (WDI
mode)
WDOUT output LOW time
(WDI mode)
10
ns
t
OL(WDOUT)
t
WEQH
2
0.2
×
C
o(L)(WDOUT)
0.5
t
WEQH
ns
f
o(WDIN-WEQCLK)
frequency offset
WDIN-WEQCLK
N6 = 1;
see Table 14
%
SYMBOL
PARAMETER
CONDITIONS
MIN.
TYP.
MAX.
UNIT
t
s
1
f
s
---
=
相關(guān)PDF資料 |
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