iv
3.2.10
Register Name: PHASESEL
37
. . . . . . . . . . . . . . . . . . . . . . . . .
3.2.11
Register Name: PLLFILT
37
. . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.12
Register Name: HS_WIDTH
37
. . . . . . . . . . . . . . . . . . . . . . . . .
3.2.13
Register Name: VS_WIDTH
38
. . . . . . . . . . . . . . . . . . . . . . . . .
3.2.14
Register Name: SYNC_CTRL
38
. . . . . . . . . . . . . . . . . . . . . . . .
3.2.15
Register Name: LD_THRES
38
. . . . . . . . . . . . . . . . . . . . . . . . .
3.2.16
Register Name: PLL_CTRL
39
. . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.17
Register Name: HS_COUNT_0
39
. . . . . . . . . . . . . . . . . . . . . .
3.2.18
Register Name: HS_COUNT_1
310
. . . . . . . . . . . . . . . . . . . . . .
3.2.19
Register Name: VS_COUNT_0
310
. . . . . . . . . . . . . . . . . . . . . .
3.2.20
Register Name: VS_COUNT_1
310
. . . . . . . . . . . . . . . . . . . . . .
3.2.21
Register Name: DTO_INC_0
310
. . . . . . . . . . . . . . . . . . . . . . . .
3.2.22
Register Name: DTO_INC_1
310
. . . . . . . . . . . . . . . . . . . . . . . .
3.2.23
Register Name: DTO_INC_2
311
. . . . . . . . . . . . . . . . . . . . . . . .
3.2.24
Register Name: DTO_INC_3
311
. . . . . . . . . . . . . . . . . . . . . . . .
3.2.25
Register Name: DTO_INC_4
311
. . . . . . . . . . . . . . . . . . . . . . . .
3.2.26
Register Name: SYNC_DETECT
311
. . . . . . . . . . . . . . . . . . . . .
3.2.27
Register Name: CLP_CTRL
311
. . . . . . . . . . . . . . . . . . . . . . . . .
3.2.28
Register Name: CLP_START_0
312
. . . . . . . . . . . . . . . . . . . . . .
3.2.29
Register Name: CLP_START_1
312
. . . . . . . . . . . . . . . . . . . . . .
3.2.30
Register Name: CLP_STOP_0
312
. . . . . . . . . . . . . . . . . . . . . . .
3.2.31
Register Name: CLP_STOP_1
312
. . . . . . . . . . . . . . . . . . . . . . .
3.2.32
Register Name: CH1_CLP
313
. . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.33
Register Name: CH1_COARSE
313
. . . . . . . . . . . . . . . . . . . . . .
3.2.34
Register Name: CH1_FINE
313
. . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.35
Register Name: CH2_CLP
313
. . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.36
Register Name: CH2_COARSE
313
. . . . . . . . . . . . . . . . . . . . . .
3.2.37
Register Name: CH2_FINE
313
. . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.38
Register Name: CH3_CLP
314
. . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.39
Register Name: CH3_COARSE
314
. . . . . . . . . . . . . . . . . . . . . .
3.2.40
Register Name: CH3_FINE
314
. . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.41
Register Name: PIX_TRAP_0
314
. . . . . . . . . . . . . . . . . . . . . . . .
3.2.42
Register Name: PIX_TRAP_1
314
. . . . . . . . . . . . . . . . . . . . . . . .
3.2.43
Register Name: PWDN_CTRL
314
. . . . . . . . . . . . . . . . . . . . . . .
3.2.44
Register Name: AUX_CTRL
315
. . . . . . . . . . . . . . . . . . . . . . . . .
3.2.45
Register Name: CH1_RDBK
315
. . . . . . . . . . . . . . . . . . . . . . . . .
3.2.46
Register Name: CH2_RDBK
316
. . . . . . . . . . . . . . . . . . . . . . . . .
3.2.47
Register Name: CH3_RDBK
316
. . . . . . . . . . . . . . . . . . . . . . . . .
3.2.48
Register Name: OFM_CTRL
316
. . . . . . . . . . . . . . . . . . . . . . . . .
4
Parameter Measurement Information
41
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.1
Timing Diagram—24-Bit Parallel Mode
41
. . . . . . . . . . . . . . . . . . . . . . . . .
4.2
Timing Diagram—16-Bit Parallel Mode
42
. . . . . . . . . . . . . . . . . . . . . . . . .
4.3
Timing Diagram—48-Bit Interleaved Mode
43
. . . . . . . . . . . . . . . . . . . . . .
4.4
Timing Diagram—48-Bit Parallel Mode
44
. . . . . . . . . . . . . . . . . . . . . . . . .