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參數(shù)資料
| 型號(hào)： | TMP90C400 |
| 廠商： | Toshiba Corporation |
| 元件分類： | 通用總線功能 |
| 英文描述： | High Speed Advanced CMOS 8-bit Microcontroller,Integrating 8-Bit CPU,RAM，ROM，General Serial Interface,Multifunction Timer/Event Counter(高速、先進(jìn)的 CMOS 8位微控制器（芯片集成了8位CPU,ROM，RAM，通用串行接口，多功能定時(shí)器/事件計(jì)數(shù)器）) |
| 中文描述： | 采用先進(jìn)的CMOS高速8位微控制器，集成8位CPU，內(nèi)存，光盤，通用串行接口，多功能定時(shí)器/事件計(jì)數(shù)器（高速，先進(jìn)的的CMOS 8位微控制器（芯片集成了8位的CPU，ROM和RAM內(nèi)存，通用串行接口，多功能定時(shí)器/事件計(jì)數(shù)器）） |
| 文件頁數(shù)： | 27/100頁 |
| 文件大小： | 2591K |
| 代理商： | TMP90C400 |
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TOSHIBA CORPORATION
27
TMP90C400/401
3.4.2 IDLE 1 Mode
Figure 3.4 (3) illustrates the timing for releasing the HALT state
by interrupts in the IDLE 1 mode.
In the IDLE 1 mode, only the internal oscillator and the
watchdog timer operate. The system clock in the MCU stops,
and the CLK signal is fixed at the “1”.
In the halt state, an interrupt request is sampled asynchronously
with the system clock, however the HALT release (restart of
operating) synchronously with the system clock.
Note: Interrupt requests except external non-maskable
interrupt (NMI) are prohibited through the HALT
period in this mode.
Figure 3.4 (3). Timing Chart of HALT Released by Interrupts in IDLE1 Mode
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TMP90C401 | High Speed Advanced CMOS 8-bit Microcontroller,Integrating 8-Bit CPU,RAM，ROM，General Serial Interface,Multifunction Timer/Event Counter(高速、先進(jìn)的 CMOS 8位微控制器（芯片集成了8位CPU,ROM，RAM，通用串行接口，多功能定時(shí)器/事件計(jì)數(shù)器）) |
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參數(shù)描述 |
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