參數(shù)資料
型號： TMS320C6713BGDPA200
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號處理
英文描述： FLOATING-POINT DIGITAL SIGNAL PROCESSORS
中文描述： 浮點數(shù)字信號處理器
文件頁數(shù)： 89/150頁
文件大?。?/td> 2039K
代理商： TMS320C6713BGDPA200
TMS320C6713, TMS320C6713B
FLOATING-POINT DIGITAL SIGNAL PROCESSORS
SPRS186I
DECEMBER 2001
REVISED MAY 2004
89
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251
1443
power-down mode logic
Figure 20 shows the power-down mode logic on the C6713/13B.
PWRD
Internal Clock Tree
CPU
IFR
IER
CSR
PD1
PD2
Power-
Down
Logic
Clock
PLL
CLKIN
RESET
PD3
Internal
Peripherals
Clock
Distribution
and Dividers
External input clocks, with the exception of CLKIN and CLKOUT3, are
not
gated by the power-down mode logic.
TMS320C6713/13B
CLKOUT2
Figure 20. Power-Down Mode Logic
triggering, wake-up, and effects
The power-down modes and their wake-up methods are programmed by setting the PWRD field (bits 15
10)
of the control status register (CSR). The PWRD field of the CSR is shown in Figure 21 and described in Table 45.
When writing to the CSR, all bits of the PWRD field should be set at the same time. Logic 0 should be used when
“writing” to the reserved bit (bit 15) of the PWRD field. The CSR is discussed in detail in the
TMS320C6000 CPU
and Instruction Set Reference Guide
(literature number SPRU189).
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PDF描述
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