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參數(shù)資料
| 型號： | UPD30102GM-66-8EV |
| 廠商： | NEC Corp. |
| 英文描述： | 64/32-bit Microprocessor |
| 中文描述： | 64/32微處理器 |
| 文件頁數(shù)： | 214/701頁 |
| 文件大?。?/td> | 2329K |
| 代理商： | UPD30102GM-66-8EV |
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CHAPTER 8 CACHE MEMORY
214
The V
R
4100 CPU core has two on-chip caches: one holds instructions (the instruction cache), the other holds
data (the data cache). The instruction and data caches can be read in one PClock cycle.
Data writes are pipelined and can complete at a rate of one per PClock cycle. In the first stage of the cycle, the
store address is translated and the tag is checked; in the second stage, the data is written into the data RAM.
8.2 CACHE ORGANIZATION
This section describes the organization of the on-chip data and instruction caches. Figure 8-2 provides a block
diagram of the V
R
4100 CPU core cache and memory model.
Figure 8-2. Cache Support
V
R
4100 CPU core
Cache controller
I-cache
D-cache
Caches
Main memory
I-cache:
D-cache: Data cache
Instruction cache
(1) Cache Line Lengths
A cache line is the smallest unit of information that can be fetched from main memory for the cache, and that is
represented by a single tag.
The line size for the instruction/data cache is 4 words (16 bytes).
For cache tag, refer to
8.2.1
and
8.2.1
.
(2) Cache Sizes
The instruction cache in the V
R
4100 CPU core is 4 Kbytes; the data cache is 1 Kbytes.
8.2.1 Organization of the Instruction Cache (I-Cache)
Each line of I-cache data (although it is actually an instruction, it is referred to as data to distinguish it from its tag)
has an associated 24-bit tag that contains a 22-bit physical address, a single Valid bit, and a single Parity bit. Word
parity is used on I-cache data (1 bit of parity per word).
The V
R
4100 CPU core I-cache has the following characteristics:
—
direct-mapped
—
indexed with a virtual address
—
checked with a physical tag
—
organized with a 4-word (16-byte) cache line.
Figure 8-3 shows the format of a 4-word (16-byte) I-cache line.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD30102S1-54-3C | 64/32-bit Microprocessor |
| UPD30102S1-66-3C | 64/32-bit Microprocessor |
| UPD30550F2-300-NN1 | VR5500⑩ 64-/32-BIT MICROPROCESSOR |
| UPD30550F2-400-NN1 | VR5500⑩ 64-/32-BIT MICROPROCESSOR |
| UPD4168 | 8,192 x 8-BIT NMOS XRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD30102S1-54-3C | 制造商:NEC 制造商全稱:NEC 功能描述:64/32-bit Microprocessor |
| UPD30102S1-66-3C | 制造商:NEC 制造商全稱:NEC 功能描述:64/32-bit Microprocessor |
| UPD30111S1-70-3C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MICROPROCESSOR|32-BIT|CMOS|BGA|224PIN|PLASTIC |
| UPD30121 | 制造商:NEC 制造商全稱:NEC 功能描述:VR4121TM 64-/32-BIT MICROPROCESSOR |
| UPD30121F1-131-GA1 | 制造商:NEC 制造商全稱:NEC 功能描述:VR4121TM 64-/32-BIT MICROPROCESSOR |
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