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參數(shù)資料
| 型號： | UPD30102GM-66-8EV |
| 廠商： | NEC Corp. |
| 英文描述： | 64/32-bit Microprocessor |
| 中文描述： | 64/32微處理器 |
| 文件頁數(shù)： | 559/701頁 |
| 文件大?。?/td> | 2329K |
| 代理商： | UPD30102GM-66-8EV |
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CHAPTER 27 CPU INSTRUCTION SET DETAILS
559
CACHE
Cache
(Continued)
CACHE
Bits 20...18 (this value is listed under the
Code
column) of the instruction specify the operation as follows:
Code
Cache
Name
Operation
0
I
Index_Invalidate
Set the cache state of the cache block to Invalid.
0
D
Index_Write_Back
Invalidate
Examine the cache state and W bit of the primary data cache block at the index
specified by the virtual address. If the state is not Invalid and the W bit is set, then
write back the block to memory. The address to write is taken from the primary
cache tag. Set cache state of primary cache block to Invalid.
1
I, D
Index_Load_Tag
Read the tag for the cache block at the specified index and place it into the TagLo
CP0 registers, ignoring parity errors. Also load the data parity bits into the ECC
register.
2
I, D
Index_Store_Tag
Write the tag for the cache block at the specified index from the TagLo and TagHi
CP0 registers.
3
D
Create_Dirty_
Exclusive
This operation is used to avoid loading data needlessly from memory when writing
new contents into an entire cache block. If the cache block does not contain the
specified address, and the block is dirty, write it back to the memory. In all cases,
set the cache state to Dirty.
4
I, D
Hit_Invalidate
If the cache block contains the specified address, mark the cache block invalid.
5
D
Hit_Write_Back
Invalidate
If the cache block contains the specified address, write back the data if it is dirty, and
mark the cache block invalid.
5
I
Fill
Fill the primary instruction cache block from memory. If the CE bit of the Status
register is set, the contents of the ECC register is used instead of the computed
parity bits for addressed doubleword when written to the instruction cache.
6
D
Hit_Write_Back
If the cache block contains the specified address and the W bit is set, write back the
data to memory and clear the W bit.
6
I
Hit_Write_Back
If the cache block contains the specified address, write back the data unconditionally.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD30102S1-54-3C | 64/32-bit Microprocessor |
| UPD30102S1-66-3C | 64/32-bit Microprocessor |
| UPD30550F2-300-NN1 | VR5500⑩ 64-/32-BIT MICROPROCESSOR |
| UPD30550F2-400-NN1 | VR5500⑩ 64-/32-BIT MICROPROCESSOR |
| UPD4168 | 8,192 x 8-BIT NMOS XRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD30102S1-54-3C | 制造商:NEC 制造商全稱:NEC 功能描述:64/32-bit Microprocessor |
| UPD30102S1-66-3C | 制造商:NEC 制造商全稱:NEC 功能描述:64/32-bit Microprocessor |
| UPD30111S1-70-3C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MICROPROCESSOR|32-BIT|CMOS|BGA|224PIN|PLASTIC |
| UPD30121 | 制造商:NEC 制造商全稱:NEC 功能描述:VR4121TM 64-/32-BIT MICROPROCESSOR |
| UPD30121F1-131-GA1 | 制造商:NEC 制造商全稱:NEC 功能描述:VR4121TM 64-/32-BIT MICROPROCESSOR |
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