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參數(shù)資料
| 型號： | UPD70F3454GF-GAS-AX |
| 廠商： | Renesas Electronics America |
| 文件頁數(shù)： | 44/352頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 32BIT 256KB FLASH 100LQFP |
| 標(biāo)準(zhǔn)包裝： | 400 |
| 系列： | V850E/Ix3 |
| 核心處理器： | V850ES |
| 芯體尺寸： | 32-位 |
| 速度： | 64MHz |
| 連通性： | CSI，EBI/EMI，I²C，UART/USART |
| 外圍設(shè)備： | DMA，LVD，PWM，WDT |
| 輸入/輸出數(shù)： | 56 |
| 程序存儲器容量： | 256KB（256K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 12K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3.5 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 10x12b，8x10b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-LQFP |
| 包裝： | 托盤 |
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PIC24FV32KA304 FAMILY
DS39995C-page 138
2011-2012 Microchip Technology Inc.
11.2.2
I/O PORT WRITE/READ TIMING
One instruction cycle is required between a port
direction change or port write operation and a read
operation of the same port. Typically, this instruction
would be a NOP.
11.3
Input Change Notification
The input change notification function of the I/O ports
allows the PIC24FV32KA304 family of devices to
generate interrupt requests to the processor in
response to a Change-of-State (COS) on selected
input pins. This feature is capable of detecting input
change of states, even in Sleep mode, when the clocks
are disabled. Depending on the device pin count, there
are up to 23 external signals (CN0 through CN22) that
may be selected (enabled) for generating an interrupt
request on a Change-of-State.
There are six control registers associated with the CN
module. The CNEN1 and CNEN2 registers contain the
interrupt enable control bits for each of the CN input
pins. Setting any of these bits enables a CN interrupt
for the corresponding pins.
Each CN pin also has a weak pull-up/pull-down
connected to it. The pull-ups act as a current source
that is connected to the pin. The pull-downs act as a
current sink to eliminate the need for external resistors
when push button or keypad devices are connected.
On any pin, only the pull-up resistor or the pull-down
resistor should be enabled, but not both of them. If the
push button or the keypad is connected to VDD, enable
the pull-down, or if they are connected to VSS, enable
the pull-up resistors. The pull-ups are enabled
separately, using the CNPU1 and CNPU2 registers,
which contain the control bits for each of the CN pins.
Setting any of the control bits enables the weak
pull-ups for the corresponding pins. The pull-downs are
enabled separately, using the CNPD1 and CNPD2
registers, which contain the control bits for each of the
CN pins. Setting any of the control bits enables the
weak pull-downs for the corresponding pins.
When the internal pull-up is selected, the pin uses VDD
as the pull-up source voltage. When the internal
pull-down is selected, the pins are pulled down to VSS
by an internal resistor. Make sure that there is no
external pull-up source/pull-down sink when the
internal pull-ups/pull-downs are enabled.
EXAMPLE 11-1:
PORT WRITE/READ EXAMPLE
Note:
Pull-ups and pull-downs on change notifi-
cation pins should always be disabled
whenever the port pin is configured as a
digital output.
MOV
0xFF00, W0;
//Configure PORTB<15:8> as inputs and PORTB<7:0> as outputs
MOV
W0, TRISB;
NOP;
//Delay 1 cycle
BTSS
PORTB, #13;
//Next Instruction
Equivalent ‘C’ Code
TRISB = 0xFF00;
//Configure PORTB<15:8> as inputs and PORTB<7:0> as outputs
NOP();
//Delay 1 cycle
if(PORTBbits.RB13 == 1)
// execute following code if PORTB pin 13 is set.
{
}
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