參數(shù)資料
型號(hào)： UPD70F3454GF-GAS-AX
廠商： Renesas Electronics America
文件頁數(shù)： 68/352頁
文件大小： 0K
描述： MCU 32BIT 256KB FLASH 100LQFP
標(biāo)準(zhǔn)包裝： 400
系列： V850E/Ix3
核心處理器： V850ES
芯體尺寸： 32-位
速度： 64MHz
連通性： CSI，EBI/EMI，I²C，UART/USART
外圍設(shè)備： DMA，LVD，PWM，WDT
輸入/輸出數(shù)： 56
程序存儲(chǔ)器容量： 256KB（256K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 12K x 8
電壓 - 電源 (Vcc/Vdd)： 3.5 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 10x12b，8x10b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 100-LQFP
包裝： 托盤
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User’s Manual U18279EJ3V0UD
14
15.9
Control Flow ........................................................................................................................... 793
15.10 Cautions .................................................................................................................................. 804
CHAPTER 16 CLOCKED SERIAL INTERFACE B (CSIB)............................................................... 806
16.1
Mode Switching Between CSIB and Other Serial Interface ............................................... 806
16.1.1
Mode switching between CSIB0 and UARTA0 ..........................................................................806
16.1.2
Mode switching between CSIB1 and UARTA2 ..........................................................................807
16.1.3
Mode switching between CSIB2 and UARTB ............................................................................808
16.2
Features .................................................................................................................................. 809
16.3
Configuration.......................................................................................................................... 810
16.4
Control Registers ................................................................................................................... 812
16.5
Operation ................................................................................................................................ 819
16.5.1
Single transfer mode (master mode, transmission mode) .........................................................819
16.5.2
Single transfer mode (master mode, reception mode)...............................................................821
16.5.3
Single transfer mode (master mode, transmission/reception mode)..........................................823
16.5.4
Single transfer mode (slave mode, transmission mode) ............................................................825
16.5.5
Single transfer mode (slave mode, reception mode) .................................................................827
16.5.6
Single transfer mode (slave mode, transmission/reception mode) ............................................829
16.5.7
Continuous transfer mode (master mode, transmission mode) .................................................831
16.5.8
Continuous transfer mode (master mode, reception mode).......................................................833
16.5.9
Continuous transfer mode (master mode, transmission/reception mode)..................................836
16.5.10 Continuous transfer mode (slave mode, transmission mode) ....................................................840
16.5.11 Continuous transfer mode (slave mode, reception mode) .........................................................842
16.5.12 Continuous transfer mode (slave mode, transmission/reception mode) ....................................845
16.5.13 Reception error..........................................................................................................................849
16.5.14 Clock timing ...............................................................................................................................850
16.6
Output Pins ............................................................................................................................. 852
CHAPTER 17 I
2C BUS .......................................................................................................................... 853
17.1
Mode Switching Between I
2C and UARTA1 ......................................................................... 853
17.2
Features .................................................................................................................................. 854
17.3
Configuration.......................................................................................................................... 857
17.4
Registers ................................................................................................................................. 859
17.5
Functions ................................................................................................................................ 873
17.5.1
Pin configuration........................................................................................................................873
17.6
I
2C Bus Definitions and Control Methods ............................................................................ 874
17.6.1
Start condition............................................................................................................................874
17.6.2
Addresses..................................................................................................................................875
17.6.3
Transfer direction specification ..................................................................................................876
17.6.4
ACK ...........................................................................................................................................877
17.6.5
Stop condition............................................................................................................................878
17.6.6
Wait state ..................................................................................................................................879
17.6.7
Wait state cancellation method..................................................................................................881
17.7
I
2C Interrupt Request Signals (INTIIC).................................................................................. 882
17.7.1
Master device operation ............................................................................................................883
17.7.2
Slave device operation (when receiving slave address data (address match))..........................886
17.7.3
Slave device operation (when receiving extension code) ..........................................................890
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PDF描述
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