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參數(shù)資料
| 型號： | UPD70F3454GF-GAS-AX |
| 廠商： | Renesas Electronics America |
| 文件頁數(shù)： | 75/352頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 32BIT 256KB FLASH 100LQFP |
| 標(biāo)準(zhǔn)包裝： | 400 |
| 系列： | V850E/Ix3 |
| 核心處理器： | V850ES |
| 芯體尺寸： | 32-位 |
| 速度： | 64MHz |
| 連通性： | CSI，EBI/EMI，I²C，UART/USART |
| 外圍設(shè)備： | DMA，LVD，PWM，WDT |
| 輸入/輸出數(shù)： | 56 |
| 程序存儲器容量： | 256KB（256K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 12K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3.5 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 10x12b，8x10b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-LQFP |
| 包裝： | 托盤 |
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PIC24FV32KA304 FAMILY
DS39995C-page 166
2011-2012 Microchip Technology Inc.
REGISTER 16-2:
SPIXCON1: SPIx CONTROL REGISTER 1
U-0
R/W-0
—
DISSCK
DISSDO
MODE16
SMP
CKE(1)
bit 15
bit 8
R/W-0
SSEN
CKP
MSTEN
SPRE2
SPRE1
SPRE0
PPRE1
PPRE0
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 15-13
Unimplemented:
Read as ‘0’
bit 12
DISSCK:
Disable SCKx pin bit (SPIx Master modes only)
1
= Internal SPIx clock is disabled, pin functions as an I/O
0
= Internal SPIx clock is enabled
bit 11
DISSDO:
Disables SDOx pin bit
1
= SDOx pin is not used by the module; pin functions as an I/O
0
= SDOx pin is controlled by the module
bit 10
MODE16:
Word/Byte Communication Select bit
1
= Communication is word-wide (16 bits)
0
= Communication is byte-wide (8 bits)
bit 9
SMP:
SPIx Data Input Sample Phase bit
Master mode:
1
= Input data is sampled at the end of data output time
0
= Input data is sampled at the middle of data output time
Slave mode:
SMP must be cleared when SPIx is used in Slave mode.
bit 8
CKE:
SPIx Clock Edge Select bit(1)
1
= Serial output data changes on transition from active clock state to Idle clock state (see bit 6)
0
= Serial output data changes on transition from Idle clock state to active clock state (see bit 6)
bit 7
SSEN:
Slave Select Enable bit (Slave mode)
1
=SSx pin is used for Slave mode
0
=SSx pin is not used by the module; pin is controlled by port function
bit 6
CKP:
Clock Polarity Select bit
1
= Idle state for clock is a high level; active state is a low level
0
= Idle state for clock is a low level; active state is a high level
bit 5
MSTEN:
Master Mode Enable bit
1
= Master mode
0
=Slave mode
bit 4-2
SPRE<2:0>:
Secondary Prescale bits (Master mode)
111
= Secondary prescale 1:1
110
= Secondary prescale 2:1
.
000
= Secondary prescale 8:1
Note 1:
The CKE bit is not used in the Framed SPI modes. The user should program this bit to ‘0’ for the Framed
SPI modes (FRMEN = 1).
相關(guān)PDF資料 |
PDF描述 |
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