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參數(shù)資料
| 型號： | UPD720122F1-DN2 |
| 廠商： | NEC Corp. |
| 英文描述： | MOS Integrated Circuit |
| 中文描述： | 馬鞍山集成電路 |
| 文件頁數(shù)： | 56/82頁 |
| 文件大?。?/td> | 650K |
| 代理商： | UPD720122F1-DN2 |
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Data Sheet S16685EJ2V0DS
56
μ
PD720122
(2) External local bus 8-bit mode
(a) External local bus 8-bit mode DMA single mode read transfer timing
Symbol
Parameter
Min.
Typ.
Max.
Unit
L8T21
DMA request acknowledge setup time (EP1_RDB
↓
)
0
∞
ns
L8T22
DMA request off time 1 (EP1_DACKB
↓
)
10
ns
L8T23
DMA single mode read transfer cycle time
91
∞
ns
L8T24
Read command width
57
∞
ns
L8T25
Read command inactive time
34
∞
ns
L8T26
Read data delay time (EP1_RDB
↓
)
57
ns
L8T27
Buffer direction change time (EP1_RDB
↓
)
14
ns
L8T28
Read data hold time (EP1_RDB
↑
)
4
ns
L8T31
EP1_STOPB delay time (EP1_RDB
↓
)
15
ns
L8T32
EP1_STOPB delay time (EP1_RDB
↑
)
3
ns
L8T33
DMA request acknowledge hold time (EP1_RDB
↑
)
0
∞
ns
L8T34
Undefined
ns
Remarks 1.
Use of EP1_TCB is prohibited in the 8-bit external local bus mode. Clamp this signal to the inactive
status.
LD15 to 8 are undefined in the 8-bit external local bus mode (these signals are invalid when input and
undefined when output).
It is assumed that the external pin capacitance is 15 pF (data bus = 50 pF).
2.
3.
(Overall)
EP1_DRQB
EP1_TCB
LD7 to LD0
EP1_RDB
EP1_DACKB
N cycle
N
1 cycle
1 cycle
L8t
22
L8t
23
L8t
24
L8t
25
L8t
26
L8t
28
High level
EP1_STOPB
High level
EP1_STOPB is not asserted in
the case of a full packet.
L8t
21
L8t
27
L8t
31
L8t
32
L8t
33
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD720122GC-9EU | MOS Integrated Circuit |
| UPD720130GC-9EU | USB2.0 to IDE Bridge |
| UPD720130GC-9EU-SIN | USB2.0 to IDE Bridge |
| UPD720130 | USB2.0 to IDE Bridge |
| UPD720133 | MOS Integrated Circuit |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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