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參數(shù)資料
| 型號： | UPD720122F1-DN2 |
| 廠商： | NEC Corp. |
| 英文描述： | MOS Integrated Circuit |
| 中文描述： | 馬鞍山集成電路 |
| 文件頁數(shù)： | 60/82頁 |
| 文件大?。?/td> | 650K |
| 代理商： | UPD720122F1-DN2 |
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Data Sheet S16685EJ2V0DS
60
μ
PD720122
(c) External local bus 8-bit mode DMA demand read transfer timing
Symbol
Parameter
Min.
Typ.
Max.
Unit
L8T45
DMA request acknowledge setup time (EP1_RDB
↓
)
0
∞
ns
L8T46
DMA demand mode read transfer cycle time
90
∞
ns
L8T47
Read command width
56
∞
ns
L8T48
Read command inactive time
34
∞
ns
L8T49
Read data delay time (EP1_RDB
↓
)
56
ns
L8T50
Buffer direction change time (EP1_RDB
↓
)
14
ns
L8T51
Read data hold time (EP1_RDB
↑
)
4
ns
L8T54
EP1_STOPB delay time (EP1_RDB
↓
)
15
ns
L8T55
EP1_STOPB delay time (EP1_RDB
↑
)
3
ns
L8T56
DMA request off time (EP1_RDB
↑
)
60
ns
L8T57
DMA request acknowledge hold time (EP1_RDB
↑
)
0
∞
ns
Remarks 1.
Use of EP1_TCB is prohibited in the 8-bit external local bus mode. Clamp this signal to the inactive
status.
LD15 to 8 are undefined in the 8-bit external local bus mode (these signals are invalid when input and
undefined when output).
It is assumed that the external pin capacitance is 15 pF (data bus = 50 pF).
2.
3.
(Overall)
EP1_DRQB
EP1_TCB
LD7 to LD0
EP1_RDB
EP1_DACKB
N cycle
N
1 cycle
1 cycle
L8t
46
L8t
47
L8t
48
L8t
49
L8t
51
L8t
56
High level
EP1_STOPB
High level
L8t
54
L8t
55
L8t
57
EP1_STOPB is not asserted in the
case of a full Packet.
L8t
50
L8t
45
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| UPD720130GC-9EU | USB2.0 to IDE Bridge |
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| UPD720130 | USB2.0 to IDE Bridge |
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參數(shù)描述 |
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