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參數(shù)資料
| 型號： | UPD780204 |
| 廠商： | NEC Corp. |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8-Bit Single-Chip Microcontrollers |
| 中文描述： | 8位單芯片微控制器 |
| 文件頁數(shù)： | 213/418頁 |
| 文件大小： | 2496K |
| 代理商： | UPD780204 |
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CHAPTER 13 SERIAL INTERFACE CHANNEL 0
213
User
’
s Manual U11302EJ4V0UM
3-wire serial
I/O mode
SI0
Note 2
(input)
SO0
(CMOS output)
PM25
P25
PM26
P26
PM27
P27
Figure 13-3. Format of Serial Operating Mode Register 0
R/W
CSIM CSIM
01
Serial interface channel 0 clock selection
00
0
x
Input clock to SCK0 pin from off-chip
1
0
8-bit timer register 2 (TM2) output
1
1
Clock specified with bits 0 to 3 of timer clock select register 3 (TCL3)
R/W
CSIM CSIM CSIM
04
Operating
mode
Start
bit
SI0/P25
pin function
SO0/P26
pin function
SCK0/P27
pin function
03
02
0
MSB
SCK0
0
×
1
×
0
0
0
1
(CMOS I/O)
1
LSB
Note 3 Note 3
SBI mode
MSB
P25
SB1
SCK0
0
0
0
0
1
(CMOS I/O)
(N-ch open-drain
I/O)
(CMOS I/O)
1
0
Note 3 Note 3
SB0
P26
1
0
0
0
1
(N-ch open-drain
I/O)
(CMOS I/O)
Note 3 Note 3
2-wire serial
I/O mode
MSB
P25
SB1
SCK0
0
0
0
0
1
(CMOS I/O)
(N-ch open-drain (N-ch open-drain
I/O)
I/O)
1
1
Note 3 Note 3
SB0
P26
1
0
0
0
1
(N-ch open-drain
I/O)
(CMOS I/O)
R/W
WUP
Wakeup function control
Note 4
0
Interrupt request signal generation with each serial transfer in any mode
Interrupt request signal generation when the address received after bus release (when CMDD = RELD = 1) matches the
1
slave address register (SVA) in SBI mode
R
COI
Slave address comparison result flag
Note 5
0
Slave address register (SVA) not equal to serial I/O shift register 0 (SIO0) data
1
Slave address register (SVA) equal to serial I/O shift register 0 (SIO0) data
R/W
CSIE0
Serial interface channel 0 operation control
0
Operation stopped
1
Operation enabled
Notes 1.
Bit 6 (COI) is a read-only bit.
2.
Can be used as P25 (CMOS input) when used only for transmission.
3.
Can be used freely as port function.
4.
To use the wakeup function (WUP = 1), clear bit 5 (SIC) of the interrupt timing specification
register (SINT) to 0.
5.
COI becomes 0 when CSIE0 = 0.
Remark
×
:
PM
××
: Port mode register
P
××
:
Port output latch
don
’
t care
CSIE0
COI WUPC04
CSIM
03
CSIM
02
CSIM
01
CSIM
00
<7> <6> <5>
4
3
2
1
0
CSIM0
Symbol
FF60H 00H R/W
Note 1
Address After reset R/W
相關PDF資料 |
PDF描述 |
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