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參數(shù)資料
| 型號： | UPD780204 |
| 廠商： | NEC Corp. |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8-Bit Single-Chip Microcontrollers |
| 中文描述： | 8位單芯片微控制器 |
| 文件頁數(shù)： | 392/418頁 |
| 文件大?。?/td> | 2496K |
| 代理商： | UPD780204 |
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CHAPTER 20 INSTRUCTION SET
392
User’s Manual U11302EJ4V0UM
Instruc- Mnemonic
tion
Group
Operands
Bytes
Operation
CALL
!addr16
3
7
–
(SP–1)
←
(PC+3)
H
, (SP–2)
←
(PC+3)
L
,
PC
←
addr16, SP
←
SP–2
(SP–1)
←
(PC+2)
H
, (SP–2)
←
(PC+2)
L
,
PC
15–11
←
00001, PC
10–0
←
addr11,
SP
←
SP–2
(SP–1)
←
(PC+1)
H
, (SP–2)
←
(PC+1)
L
,
PC
H
←
(00000000, addr5+1),
PC
L
←
(00000000, addr5),
SP
←
SP–2
(SP–1)
←
PSW, (SP–2)
←
(PC+1)
H
,
(SP–3)
←
(PC+1)
L
, PC
H
←
(003FH),
PC
L
←
(003EH), SP
←
SP–3, IE
←
0
PC
H
←
(SP+1), PC
L
←
(SP),
SP
←
SP+2
PC
H
←
(SP+1), PC
L
←
(SP),
PSW
←
(SP+2), SP
←
SP+3,
NMIS
←
0
PC
H
←
(SP+1), PC
L
←
(SP),
PSW
←
(SP+2), SP
←
SP+3
(SP–1)
←
PSW, SP
←
SP–1
(SP–1)
←
rp
H
, (SP–2)
←
rp
L
,
SP
←
SP–2
PSW
←
(SP), SP
←
SP+1
rp
H
←
(SP+1), rp
L
←
(SP),
SP
←
SP+2
SP
←
word
SP
←
AX
AX
←
SP
PC
←
addr16
PC
←
PC + 2 + jdisp8
PC
H
←
A, PC
L
←
X
PC
←
PC + 2 + jdisp8 if CY = 1
PC
←
PC + 2 + jdisp8 if CY = 0
PC
←
PC + 2 + jdisp8 if Z = 1
PC
←
PC + 2 + jdisp8 if Z = 0
CALLF
!addr11
2
5
–
CALLT
[addr5]
1
6
–
BRK
1
6
–
RET
1
6
–
RETI
1
6
–
R
R
R
RETB
1
6
–
R
R
R
PUSH
PSW
1
2
–
rp
1
4
–
POP
PSW
1
2
–
R
R
R
rp
1
4
–
MOVW
SP, #word
4
–
10
SP, AX
2
–
8
AX, SP
2
–
8
BR
!addr16
3
6
–
$addr16
2
6
–
AX
2
8
–
BC
$addr16
2
6
–
BNC
$addr16
2
6
–
BZ
$addr16
2
6
–
BNZ
$addr16
2
6
–
Notes 1.
When the internal high-speed RAM area is accessed or an instruction with no data access.
2.
When an area except the internal high-speed RAM area is accessed.
Remark
One instruction clock cycle is one cycle of the CPU clock (f
CPU
) selected by the processor clock control
register (PCC).
Z
AC CY
Note 2
Note 1
Clocks
Flag
Call
return
Stack
manipu-
lation
Uncondi-
tional
branch
Condi-
tional
branch
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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