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參數(shù)資料
| 型號： | UPD78F9201MA-CAC-A |
| 廠商： | Renesas Electronics America |
| 文件頁數(shù)： | 124/158頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 8BIT 2KB FLASH 128B RAM |
| 標(biāo)準(zhǔn)包裝： | 400 |
| 系列： | 78K0S/Kx1+ |
| 核心處理器： | 78K0S |
| 芯體尺寸： | 8-位 |
| 速度： | 10MHz |
| 外圍設(shè)備： | LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 7 |
| 程序存儲器容量： | 2KB（2K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 128 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 4x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 10-LSSOP（0.225"，5.72mm 寬） |
| 包裝： | 托盤 |
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CHAPTER 4 PORT FUNCTIONS
User’s Manual U18172EJ3V0UD
66
4.2.3
Port 4
Port 4 is a 2-bit I/O port with an output latch. Each bit of this port can be set to the input or output mode by using
port mode register 4 (PM4)
Note. When the P40 and P43 pins are used as an input port, an on-chip pull-up resistor can
be connected in 1-bit units by using pull-up resistor option register 4 (PU4).
Reset signal generation sets port 4 to the input mode.
Figures 4-11 shows the block diagram of port 4.
Note In
μPD78F920x, set PM41, PM42, and PM44 to PM47 to "0" at program initialization.
Figure 4-11. Block Diagram of P40 and P43
P40, P43
WRPU
RD
WRPORT
WRPM
PU40, PU43
PM40, PM43
VDD
P-ch
PU4
PM4
Internal
bus
Output latch
(P40, P43)
Selector
P4
P4:
Port register 4
PU4:
Pull-up resistor option register 4
PM4:
Port mode register 4
RD:
Read signal
WR
××: Write signal
4.3
Registers Controlling Port Functions
The ports are controlled by the following four types of registers.
Port mode registers (PM2 to PM4)
Port registers (P2 to P4)
Port mode control register 2 (PMC2) (μPD78F920x only)
Pull-up resistor option registers (PU2 to PU4)
<R>
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