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參數(shù)資料
| 型號： | XC2S150-6FG456C |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 53/99頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 2.5V C-TEMP 456-FBGA |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 系列： | Spartan®-II |
| LAB/CLB數(shù)： | 864 |
| 邏輯元件/單元數(shù)： | 3888 |
| RAM 位總計： | 49152 |
| 輸入/輸出數(shù)： | 260 |
| 門數(shù)： | 150000 |
| 電源電壓： | 2.375 V ~ 2.625 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 456-BBGA |
| 供應(yīng)商設(shè)備封裝： | 456-FBGA |
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Spartan-II FPGA Family: DC and Switching Characteristics
DS001-3 (v2.8) June 13, 2008
Module 3 of 4
Product Specification
57
R
IOB Input Delay Adjustments for Different Standards(1)
Input delays associated with the pad are specified for LVTTL. For other standards, adjust the delays by the values shown. A
delay adjusted in this way constitutes a worst-case limit.
Symbol
Description
Standard
Speed Grade
Units
-6
-5
Data Input Delay Adjustments
TILVTTL
Standard-specific data input delay
adjustments
LVTTL
0
ns
TILVCMOS2
LVCMOS2
–0.04
–0.05
ns
TIPCI33_3
PCI, 33 MHz, 3.3V
–0.11
–0.13
ns
TIPCI33_5
PCI, 33 MHz, 5.0V
0.26
0.30
ns
TIPCI66_3
PCI, 66 MHz, 3.3V
–0.11
–0.13
ns
TIGTL
GTL
0.20
0.24
ns
TIGTLP
GTL+
0.11
0.13
ns
TIHSTL
HSTL
0.03
0.04
ns
TISSTL2
SSTL2
–0.08
–0.09
ns
TISSTL3
SSTL3
–0.04
–0.05
ns
TICTT
CTT
0.02
ns
TIAGP
AGP
–0.06
–0.07
ns
Notes:
1.
Input timing for LVTTL is measured at 1.4V. For other I/O standards, see the table "Delay Measurement Methodology," page 60.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XC2S150-6FG456I | 制造商:Xilinx 功能描述: |
| XC2S150-6FGG256C | 制造商:Xilinx 功能描述:FPGA SPARTAN-II 150K GATES 3888 CELLS 263MHZ 2.5V 256FBGA - Trays 制造商:Xilinx 功能描述:FPGA, 864 CLBS, 150000 GATES, 263 MHz, PBGA256 |
| XC2S150-6FGG256I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-II FPGA Family |
| XC2S150-6FGG456C | 制造商:Xilinx 功能描述:FPGA SPARTAN-II 150K GATES 3888 CELLS 263MHZ 2.5V 456FBGA - Trays 制造商:Xilinx 功能描述:IC FPGA 260 I/O 456FBGA 制造商:Xilinx 功能描述:IC FPGA SPARTAN-2C 150K 456FBGA |
| XC2S150-6FGG456I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-II FPGA Family |
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