參數(shù)資料
型號(hào)： XC3S400-4FTG256I
廠商： Xilinx Inc
文件頁(yè)數(shù)： 15/272頁(yè)
文件大?。?/td> 0K
描述： SPARTAN3A FPGA 400K STD 256FTBGA
標(biāo)準(zhǔn)包裝： 90
系列： Spartan®-3
LAB/CLB數(shù)： 896
邏輯元件/單元數(shù)： 8064
RAM 位總計(jì)： 294912
輸入/輸出數(shù)： 173
門數(shù)： 400000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 256-LBGA
供應(yīng)商設(shè)備封裝： 256-FTBGA
其它名稱： 122-1716
XC3S400-4FTG256I-ND
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Spartan-3 FPGA Family: Pinout Descriptions
DS099 (v3.1) June 27, 2013
Product Specification
111
Detailed, Functional Pin Descriptions
I/O Type: Unrestricted, General-purpose I/O Pins
After configuration, I/O-type pins are inputs, outputs, bidirectional I/O, three-state outputs, open-drain outputs, or
open-source outputs, as defined in the application
Pins labeled "IO" support all SelectIO interface signal standards except differential standards. A given device at most only
has a few of these pins.
A majority of the general-purpose I/O pins are labeled in the format “IO_Lxxy_#”. These pins support all SelectIO signal
standards, including the differential standards such as LVDS, ULVDS, BLVDS, RSDS, or LDT.
For additional information, see IOBs, page 10
TDI
Input
JTAG Test Data Input:
TDI is the serial data input for all JTAG instruction and data registers. This
pin has an internal pull-up resistor to VCCAUX during configuration.
TMS
Input
JTAG Test Mode Select:
The serial TMS input controls the operation of the JTAG port. This pin has
an internal pull-up resistor to VCCAUX during configuration.
TDO
Output
JTAG Test Data Output:
TDO is the serial data output for all JTAG instruction and data registers.
This pin has an internal pull-up resistor to VCCAUX during configuration.
VCCO: I/O bank output voltage supply pins
VCCO_#
Supply
Power Supply for Output Buffer Drivers (per bank):
These pins power the output drivers within a specific I/O bank.
VCCAUX: Auxiliary voltage supply pins
VCCAUX
Supply
Power Supply for Auxiliary Circuits:
+2.5V power pins for auxiliary circuits, including the Digital Clock
Managers (DCMs), the dedicated configuration pins (CONFIG), and the
dedicated JTAG pins. All VCCAUX pins must be connected.
VCCINT: Internal core voltage supply pins
VCCINT
Supply
Power Supply for Internal Core Logic:
+1.2V power pins for the internal logic. All pins must be connected.
GND: Ground supply pins
GND
Supply
Ground:
Ground pins, which are connected to the power supply’s return path. All
pins must be connected.
N.C.: Unconnected package pins
N.C.
Unconnected Package Pin:
These package pins are unconnected.
Notes:
1.
All unused inputs and bidirectional pins must be tied either High or Low. For unused enable inputs, apply the level that disables the
associated function. One common approach is to activate internal pull-up or pull-down resistors. An alternative approach is to externally
connect the pin to either VCCO or GND.
2.
All outputs are of the totem-pole type — i.e., they can drive High as well as Low logic levels — except for the cases where “Open Drain” is
indicated. The latter can only drive a Low logic level and require a pull-up resistor to produce a High logic level.
Table 70: Spartan-3 FPGA Pin Definitions (Cont’d)
Pin Name
Direction
Description
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PDF描述
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參數(shù)描述
XC3S400-4FTG256I4022 制造商:Xilinx 功能描述:
XC3S400-4PQ208C 功能描述:IC SPARTAN-3 FPGA 400K 208PQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:Spartan®-3 標(biāo)準(zhǔn)包裝:40 系列:Spartan® 6 LX LAB/CLB數(shù):3411 邏輯元件/單元數(shù):43661 RAM 位總計(jì):2138112 輸入/輸出數(shù):358 門數(shù):- 電源電壓:1.14 V ~ 1.26 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:676-BGA 供應(yīng)商設(shè)備封裝:676-FBGA（27x27）
XC3S400-4PQ208CES 制造商:Xilinx 功能描述:
XC3S400-4PQ208I 制造商:Xilinx 功能描述:FPGA SPARTAN-3 400K GATES 8064 CELLS 630MHZ 1.2V 208PQFP - Trays
XC3S400-4PQG208C 功能描述:IC SPARTAN-3 FPGA 400K 208-PQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:Spartan®-3 標(biāo)準(zhǔn)包裝:60 系列:XP LAB/CLB數(shù):- 邏輯元件/單元數(shù):10000 RAM 位總計(jì):221184 輸入/輸出數(shù):244 門數(shù):- 電源電壓:1.71 V ~ 3.465 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:388-BBGA 供應(yīng)商設(shè)備封裝:388-FPBGA（23x23） 其它名稱:220-1241
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