參數(shù)資料
型號(hào)： XC3S400-4FTG256I
廠商： Xilinx Inc
文件頁(yè)數(shù)： 153/272頁(yè)
文件大?。?/td> 0K
描述： SPARTAN3A FPGA 400K STD 256FTBGA
標(biāo)準(zhǔn)包裝： 90
系列： Spartan®-3
LAB/CLB數(shù)： 896
邏輯元件/單元數(shù)： 8064
RAM 位總計(jì)： 294912
輸入/輸出數(shù)： 173
門(mén)數(shù)： 400000
電源電壓： 1.14 V ~ 1.26 V
安裝類(lèi)型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 256-LBGA
供應(yīng)商設(shè)備封裝： 256-FTBGA
其它名稱(chēng)： 122-1716
XC3S400-4FTG256I-ND
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Spartan-3 FPGA Family: Pinout Descriptions
DS099 (v3.1) June 27, 2013
Product Specification
236
FG1156: 1156-lead Fine-pitch Ball Grid Array
Note: The FG(G)1156 package is discontinued. See
The 1,156-lead fine-pitch ball grid array package, FG1156, supports two different Spartan-3 devices, namely the XC3S4000
and the XC3S5000. The XC3S4000, however, has fewer I/O pins, which consequently results in 73 unconnected pins on the
FG1156 package, labeled as “N.C.” In Table 110 and Figure 53, these unconnected pins are indicated with a black diamond
symbol (
).
The XC3S5000 has a single unconnected package pin, ball AK31, which is also unconnected for the XC3S4000.
All the package pins appear in Table 110 and are sorted by bank number, then by pin name. Pairs of pins that form a
differential I/O pair appear together in the table. The table also shows the pin number for each pin and the pin type, as
defined earlier.
On ball L29 in I/O Bank 2, the unconnected pin on the XC3S4000 maps to a VREF-type pin on the XC3S5000. If the other
VREF_2 pins all connect to a voltage reference to support a special I/O standard, then also connect the N.C. pin on the
XC3S4000 to the same VREF_2 voltage.
Pinout Table
Table 110: FG1156 Package Pinout
Bank
XC3S4000
Pin Name
XC3S5000
Pin Name
FG1156
Pin Number
Type
0
IO
B9
I/O
0
IO
E17
I/O
0
IO
F6
I/O
0
IO
F8
I/O
0
IO
G12
I/O
0
IO
H8
I/O
0
IO
H9
I/O
0
IO
J11
I/O
0
N.C. (
)
IO
J9
I/O
0
N.C. (
)
IO
K11
I/O
0
IO
K13
I/O
0
IO
K16
I/O
0
IO
K17
I/O
0
IO
L13
I/O
0
IO
L16
I/O
0
IO
L17
I/O
0
IO/VREF_0
D5
VREF
0
IO/VREF_0
E10
VREF
0
IO/VREF_0
J14
VREF
0
IO/VREF_0
L15
VREF
0
IO_L01N_0/VRP_0
B3
DCI
0
IO_L01P_0/VRN_0
A3
DCI
0
IO_L02N_0
B4
I/O
0
IO_L02P_0
A4
I/O
0
IO_L03N_0
C5
I/O
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PDF描述
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