參數(shù)資料
型號： XC3S500E-5FGG320C
廠商： Xilinx Inc
文件頁數(shù)： 174/227頁
文件大?。?/td> 0K
描述： IC FPGA SPARTAN-3E 500K 320-FBGA
標準包裝： 84
系列： Spartan®-3E
LAB/CLB數(shù)： 1164
邏輯元件/單元數(shù)： 10476
RAM 位總計： 368640
輸入/輸出數(shù)： 232
門數(shù)： 500000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 320-BGA
供應(yīng)商設(shè)備封裝： 320-FBGA（19x19）
配用： 122-1536-ND - KIT STARTER SPARTAN-3E
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Spartan-3E FPGA Family: Functional Description
DS312 (v4.1) July 19, 2013
Product Specification
50
Table 30: Direct Clock Input Connections and Optional External Feedback to Associated DCMs
Package
Differential Pair
NPNP
N
P
N
P
Pin Number for Single-Ended Input
VQ100
P91
P90
P89
P88
P86
P85
P84
P83
CP132
B7
A7
C8
B8
A9
B9
C9
A10
TQ144
P131
P130
P129
P128
P126
P125
P123
P122
PQ208
P186
P185
P184
P183
P181
P180
P178
P177
FT256
D8
C8
B8
A8
A9
A10
F9
E9
FG320
D9
C9
B9
B8
A10
B10
E10
D10
FG400
A9
A10
G10
H10
E10
E11
G11
F11
FG484
B11
C11
H11
H12
C12
B12
E12
F12
Associated Global Buffers
GCLK11
GCLK10
GCLK9
GCLK8
B
U
FGMUX_X1Y10
B
U
FGMUX_X1Y11
B
U
FGMUX_X2Y10
B
U
FGMUX_X2Y11
GCLK7
GCLK6
GCLK5
GCLK4
Top Left DCM
XC3S100: N/A
XC3S250E, XC3S500E: DCM_X0Y1
XC3S1200E, XC3S1600E: DCM_X1Y3
Top Right DCM
XC3S100: DCM_X0Y1
XC3S250E, XC3S500E: DCM_X1Y1
XC3S1200E, XC3S1600E: DCM_X2Y3
H
G
F
E
Clock Line (see Table 41)
D
C
B
A
Bottom Left DCM
XC3S100: N/A
XC3S250E, XC3S500E: DCM_X0Y0
XC3S1200E, XC3S1600E: DCM_X1Y0
B
U
FGMUX_X1Y0
B
U
FGMUX_X1Y1
B
U
FGMUX_X2Y0
B
U
FGMUX_X2Y1
Bottom Right DCM
XC3S100: DCM_X0Y0
XC3S250E, XC3S500E: DCM_X1Y0
XC3S1200E, XC3S1600E: DCM_X2Y0
GCLK12
GCLK13
GCLK14
GCLK15
GCLK0
GCLK1
GCLK2
GCLK3
Associated Global Buffers
Package
Differential Pair
PNPN
P
N
P
N
Pin Number for Single-Ended Input
VQ100
P32
P33
P35
P36
P38
P39
P40
P41
CP132
M4
N4
M5
N5
M6
N6
P6
P7
TQ144
P50
P51
P53
P54
P56
P57
P58
P59
PQ208
P74
P75
P77
P78
P80
P81
P82
P83
FT256
M8
L8
N8
P8
T9
R9
P9
N9
FG320
N9
M9
U9
V9
U10
T10
R10
P10
FG400
W9
W10
R10
P10
P11
P12
V10
V11
FG484
V11
U11
R11
T11
R12
P12
Y12
W12
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PDF描述
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