參數(shù)資料
型號(hào)： XC3S50AN-4TQ144I
廠商： Xilinx Inc
文件頁數(shù)： 30/123頁
文件大?。?/td> 0K
描述： IC FPGA SPARTAN 3AN 144TQFP
標(biāo)準(zhǔn)包裝： 60
系列： Spartan®-3AN
LAB/CLB數(shù)： 176
邏輯元件/單元數(shù)： 1584
RAM 位總計(jì)： 55296
輸入/輸出數(shù)： 108
門數(shù)： 50000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-TQFP（20x20）
Spartan-3AN FPGA Family: DC and Switching Characteristics
DS557 (v4.1) April 1, 2011
Product Specification
14
General Recommended Operating Conditions
Table 10: General Recommended Operating Conditions
Symbol
Description
Min
Nominal
Max
Units
TJ
Junction temperature
Commercial
0
–85
°C
Industrial
–40
–100
°C
VCCINT
Internal supply voltage
1.14
1.20
1.26
V
VCCO(1)
Output driver supply voltage
1.10
–3.60
V
VCCAUX
Auxiliary supply voltage
VCCAUX = 3.3V
3.00
3.30
3.60
V
Input voltage
PCI IOSTANDARD
–0.5
–VCCO +0.5
V
All other
IOSTANDARDs
IP or IO_#
–0.5
–4.10
V
IO_Lxxy_#(3)
–0.5
–4.10
V
TIN
Input signal transition time(4)
–
500
ns
Notes:
1.
This VCCO range spans the lowest and highest operating voltages for all supported I/O standards. Table 13 lists the recommended VCCO
range specific to each of the single-ended I/O standards, and Table 15 lists that specific to the differential standards.
2.
See XAPP459, Eliminating I/O Coupling Effects when Interfacing Large-Swing Single-Ended Signals to User I/O Pins on Spartan-3 Families.
3.
For single-ended signals that are placed on a differential-capable I/O, VIN of –0.2V to –0.5V is supported but can cause increased leakage
between the two pins. See Parasitic Leakage in UG331, Spartan-3 Generation FPGA User Guide.
4.
Measured between 10% and 90% VCCO. Follow Signal Integrity recommendations.
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參數(shù)描述
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