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參數(shù)資料
型號(hào): XC5VLX220-2FF1760I
廠商: Xilinx Inc
文件頁數(shù): 40/91頁
文件大?。?/td> 0K
描述: IC FPGA VIRTEX-5 220K 1760FBGA
標(biāo)準(zhǔn)包裝: 1
系列: Virtex®-5 LX
LAB/CLB數(shù): 17280
邏輯元件/單元數(shù): 221184
RAM 位總計(jì): 7077888
輸入/輸出數(shù): 800
電源電壓: 0.95 V ~ 1.05 V
安裝類型: 表面貼裝
工作溫度: -40°C ~ 100°C
封裝/外殼: 1760-BBGA,F(xiàn)CBGA
供應(yīng)商設(shè)備封裝: 1760-FCBGA
配用: 568-5088-ND - BOARD DEMO DAC1408D750
HW-AFX-FF1760-500-G-ND - BOARD DEV VIRTEX 5 FF1760
Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
DS202 (v5.3) May 5, 2010
Product Specification
45
TCXB
CX inputs to CMUX output
0.33
0.36
0.42
ns, Max
TCXD
CX inputs to DMUX output
0.37
0.42
0.49
ns, Max
TDXD
DX inputs to DMUX output
0.38
0.42
0.49
ns, Max
TOPCYA
An input to COUT output
0.43
0.50
0.59
ns, Max
TOPCYB
Bn input to COUT output
0.39
0.44
0.51
ns, Max
TOPCYC
Cn input to COUT output
0.33
0.37
0.43
ns, Max
TOPCYD
Dn input to COUT output
0.30
0.34
0.40
ns, Max
TAXCY
AX input to COUT output
0.36
0.42
0.50
ns, Max
TBXCY
BX input to COUT output
0.26
0.30
0.37
ns, Max
TCXCY
CX input to COUT output
0.20
0.22
0.26
ns, Max
TDXCY
DX input to COUT output
0.20
0.22
0.26
ns, Max
TBYP
CIN input to COUT output
0.09
0.10
0.11
ns, Max
TCINA
CIN input to AMUX output
0.24
0.27
0.31
ns, Max
TCINB
CIN input to BMUX output
0.27
0.30
0.35
ns, Max
TCINC
CIN input to CMUX output
0.29
0.32
0.36
ns, Max
TCIND
CIN input to DMUX output
0.31
0.35
0.41
ns, Max
Sequential Delays
TCKO
Clock to AQ – DQ outputs
0.35
0.40
0.47
ns, Max
Setup and Hold Times of CLB Flip-Flops Before/After Clock CLK
TDICK/TCKDI
AX – DX input to CLK on A – D Flip Flops
0.36
0.19
0.41
0.21
0.49
0.24
ns, Min
TRCK
DX input to CLK when used as REV
0.37
0.42
0.51
ns, Min
TCECK/TCKCE
CE input to CLK on A – D Flip Flops
0.18
–0.04
0.20
–0.04
0.23
–0.04
ns, Min
TSRCK/TCKSR
SR input to CLK on A – D Flip Flops
0.41
–0.19
0.49
–0.19
0.59
–0.19
ns, Min
TCINCK/TCKCIN
CIN input to CLK on A – D Flip Flops
0.14
0.16
0.18
0.19
ns, Min
Set/Reset
TSRMIN
SR input minimum pulse width
0.90
ns, Min
TRQ
Delay from SR or REV input to AQ – DQ flip-flops
0.74
0.86
1.03
ns, Max
TCEO
Delay from CE input to AQ – DQ flip-flops
0.46
0.52
0.63
ns, Max
FTOG
Toggle frequency (for export control)
1412
1265
1098
MHz
Notes:
1.
A Zero “0” Hold Time listing indicates no hold time or a negative hold time. Negative values cannot be guaranteed “best-case”, but if a “0” is
listed, there is no positive hold time.
2.
These items are of interest for Carry Chain applications.
Table 65: CLB Switching Characteristics (Cont’d)
Symbol
Description
Speed Grade
Units
-3
-2
-1
相關(guān)PDF資料
PDF描述
XC6VHX565T-1FFG1924C IC FPGA VIRTEX 1924FCBGA
XC6VHX565T-1FFG1923C IC FPGA VIRTEX 1924FCBGA
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參數(shù)描述
XC5VLX220-2FFG1760C 功能描述:IC FPGA VIRTEX-5 220K 1760FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA(現(xiàn)場可編程門陣列) 系列:Virtex®-5 LX 產(chǎn)品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標(biāo)準(zhǔn)包裝:24 系列:XC4000E/X LAB/CLB數(shù):100 邏輯元件/單元數(shù):238 RAM 位總計(jì):3200 輸入/輸出數(shù):80 門數(shù):3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應(yīng)商設(shè)備封裝:120-CPGA(34.55x34.55)
XC5VLX220-2FFG1760I 功能描述:IC FPGA VIRTEX-5 220K 1760FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA(現(xiàn)場可編程門陣列) 系列:Virtex®-5 LX 產(chǎn)品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標(biāo)準(zhǔn)包裝:24 系列:XC4000E/X LAB/CLB數(shù):100 邏輯元件/單元數(shù):238 RAM 位總計(jì):3200 輸入/輸出數(shù):80 門數(shù):3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應(yīng)商設(shè)備封裝:120-CPGA(34.55x34.55)
XC5VLX220-3FFG1760C 制造商:Xilinx 功能描述:
XC5VLX220T 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-5 Family Overview
XC5VLX220T-1FF1738C 功能描述:IC FPGA VIRTEX-5 220K 1738FBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA(現(xiàn)場可編程門陣列) 系列:Virtex®-5 LXT 產(chǎn)品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標(biāo)準(zhǔn)包裝:24 系列:XC4000E/X LAB/CLB數(shù):100 邏輯元件/單元數(shù):238 RAM 位總計(jì):3200 輸入/輸出數(shù):80 門數(shù):3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應(yīng)商設(shè)備封裝:120-CPGA(34.55x34.55)