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參數(shù)資料
| 型號(hào)： | XRT72L50 |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, QFP-100 |
| 文件頁(yè)數(shù)： | 36/475頁(yè) |
| 文件大?。?/td> | 5760K |
| 代理商： | XRT72L50 |
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XRT72L50
SINGLE CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER
REV. P1.1.3
á
PRELIMINARY
17
86
RxAIS
O
Receive "Alarm Indication Signal" Output pin:
The Framer will assert this pin to indicate that the Alarm Indication Signal
(AIS) has been identified in the Receive DS3 or E3 data stream.
For DS3 Applications:
The Framer will assert this pin to indicate that the Alarm Indication Signal
(AIS) has been identified in the Receive DS3 data stream. An "AIS" is
detected if the payload consists of the recurring pattern of 1010... and this
pattern persists for 63 M-frames. An additional requirement for AIS indication
is that the C-bits are set to 0, and the X-bits are set to 1. This pin will be
negated when a sufficient number of frames, not exhibiting the "1010..." pat-
tern in the payload has been detected.
For E3 Applications:
The Receive Section will declare an AIS condition, if it detects two consecu-
tive E3 frames, each containing 7 or less "0s".
87
RxClk
O
Receive Clock Output Signal for Serial and Nibble/Parallel Data Inter-
face:
The exact behavior of this signal depends upon whether the XRT72L50 is
operating in the "Serial" or in the "Nibble-Parallel-Mode".
Serial Mode Operation:
In the "serial" mode, this signal is a 44.736MHz clock output signal (for DS3
applications) or 34.368MHz clock output signal (for E3 applications). The
Receive Payload Data Output Interface will update the data via the RxSer out-
put pin, upon the rising edge of this clock signal.
The user is advised to design (or configure) the Terminal Equipment to sam-
ple the data on the "RxSer" pin, upon the falling edge of this clock signal.
Nibble-Parallel Mode Operation:
In this Nibble-Parallel Mode, the XRT72L50 will derive this clock signal, from
the RxLineClk signal. The XRT72L50 will pulse this clock signal 1176 times
for each "inbound" DS3 frame (or 1074 times for each inbound “E3/ITU-T
G.832” frame, or 384 times for each inbound “E3/ITU-T G.751 frame). The
Receive Payload Data Output Interface will update the data, on the
"RxNib[3:0]" output pins upon the falling edge of this clock signal.
The user is advised to design (or configure) the Terminal Equipment to sam-
ple the data on the "RxNib[3:0] output pins, upon the rising edge of this clock
signal
88
GND
****
Ground
89
RxFrame
O
Receive Boundary of DS3 or E3 Frame Output Indicator:
The exact functionality of this output pin depends upon whether the
XRT72L50 Framer IC is operating in the “Serial” or “Nibble-Parallel” Mode.
Serial Mode Operation:
The Receive Section of the XRT72L50 will pulse this output pin “high” (for one
bit-period) when the “Receive Payload Data Output Interface” block is driving
the very first bit of a given DS3 or E3 frame, onto the “RxSer” output pin.
Nibble-Parallel Operation:
The Receive Section of the XRT72L50 will pulse this output pin “high” (for one
nibble-period), when the “Receive Payload Data Output Interface” block is
driving the very first nibble of a given DS3 or E3 frame, onto the “RxNib[3:0]
output pins.
90
VDD
****
Power Supply 3.3V + 5%
PIN DESCRIPTION
P
IN
#
P
IN
N
AME
T
YPE
D
ESCRIPTION
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT72L52IQ | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L52 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L53 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L54 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L56IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| XRT72L50-75L00PCI | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC with T75L00. RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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