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參數(shù)資料
| 型號： | XRT72L50 |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, QFP-100 |
| 文件頁數(shù)： | 66/475頁 |
| 文件大?。?/td> | 5760K |
| 代理商： | XRT72L50 |
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XRT72L50
SINGLE CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER
á
PRELIMINARY
REV. P1.1.3
47
2.2.2.2.1.2.1
The initial write operation of an Intel-type Write Burst
Access is accomplished by executing a Programmed
I/O write cycle as summarized below.
A.0
Execute a Single Ordinary (Programmed I/
O) Write cycle, as described in Steps A.1
through A.7 below.
The Initial Write Operation
A.1
Place the address of the initial target register
(or buffer location) within the Framer, on the
Address Bus pins, A[10:0].
A.2
At the same time, the Address-Decoding cir-
cuitry (within the user's system) should assert
the CS (Chip Select) input pin of the Framer, by
toggling it "Low". This step enables further
communication between the μC/μP and the
Framer Microprocessor Interface block.
A.3
Assert the ALE_AS (Address Latch Enable)
input pin "High". This step enables the Address
Bus input drivers, within the Microprocessor
Interface Block of the Framer.
A.4
After allowing the data on the Address Bus pins
to settle (by waiting the appropriate Address
Setup time), the μC/μP should then toggle the
ALE_AS input pin "Low". This step latches the
contents, on the Address Bus pins, A[10:0], into
the XRT72L50 DS3/E3 Framer Microprocessor
Interface block. At this point, the initial address
of the burst access has now been selected.
N
OTE
:
The ALE_AS input pin should remain "Low" for the
remainder of this Burst I/O Access operation.
A.5
Next, the μC/μP should indicate that this cur-
rent bus cycle is a Write operation by keeping
the RD_DS pin "High" and toggling the
WR_R/
W
(Write Strobe) pin "Low". This action also
enables the bi-directional data bus input drivers
of the Framer device.
A.6
The μC/μP places the byte (or word) that it
intends to write into the target register on the
bi-directional data bus, D[7:0].
A.7
After waiting the appropriate amount of time, for
the data (on the bi-directional data bus) to set-
tle, the μC/μP should toggle the
WR_R/W
(Write
Strobe) input pin "High". This action accom-
plishes two things.
a.
It latches the contents of the bi-directional data
bus into the XRT72L50 DS3/E3 Framer Micropro-
cessor Interface Block.
b.
It terminates the write cycle.
Figure 31 presents a timing diagram which illustrates
the behavior of the Microprocessor Interface signals,
during the initial write operation within a Burst Ac-
cess, for an Intel-type μC/μP
At the completion of this initial write cycle, the μC/μP
has written a byte or word into the first register or
buffer location (within the XRT72L50 DS3/E3 Framer)
for this particular burst access operation. In order to
illustrate this point, the byte (or word) of data, that is
being written in Figure 31 has been labeled Data to
be Written (Offset = 0x00).
F
IGURE
31. B
EHAVIOR
OF
THE
M
ICROPROCESSOR
I
NTERFACE
SIGNALS
,
DURING
THE
I
NITIAL
W
RITE
O
PERATION
OF
A
B
URST
C
YCLE
(I
NTEL
-
TYPE
P
ROCESSOR
)
RDY_DTCK
ALE_AS
A(8:0)
CS
D(7:0)
RD_DS
WR_R/W
Address of "Initial" Target Register (Offset = 0x00)
Data to be Written
(Offset = 0x00)
相關PDF資料 |
PDF描述 |
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| XRT72L50-75L00PCI | 功能描述:網(wǎng)絡控制器與處理器 IC with T75L00. RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT72L50ES-PCI | 功能描述:網(wǎng)絡控制器與處理器 IC withT73LC00A+T71D00 RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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