參數(shù)資料
型號(hào)： XRT74L73IB
廠商： EXAR CORP
元件分類： 數(shù)字傳輸電路
英文描述： 3 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
中文描述： DATACOM, FRAMER, PBGA388
封裝： 35 X 35 MM, PLASTIC, BGA-388
文件頁數(shù)： 184/488頁
文件大小： 2829K
代理商： XRT74L73IB
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XRT74L73
3 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
REV. P1.0.1
PRELIMINARY
185
Operation of the Transmit Payload Data Input In-
terface
The Transmit Payload Data Input Interface is ex-
tremely flexible, in that it permits the following config-
uration options.
The Serial or the Nibble-Parallel Interface Mode
The Loop-Timing or the TxInClk (Local Timing)
Mode
Further, if the XRT74L73 has been configured to op-
erate in the TxInClk (Local Timing) mode, then there
are two additional options.
The XRT74L73 functions as the Frame Master
(e.g., it dictates when the Terminal Equipment will
initiate the transmission of data within a new DS3
frame).
The XRT74L73 functions as the Frame Slave (e.g.,
the Terminal Equipment will dictate when the
XRT74L73 initiates the transmission of a new DS3
frame).
Given these three set of options, the Transmit Termi-
nal Input Interface can be configured to operate in
one of the six (6) following modes.
Mode 1 - Serial/Loop-Timed Mode
Mode 2 - Serial/Local-Timed/Frame Slave Mode
Mode 3 - Serial/Local-Timed/Frame Master Mode
Mode 4 - Nibble/Loop-Timed Mode
Mode 5 - Nibble/Local-Timed/Frame Slave Mode
Mode 6 - Nibble/Local-Timed/Frame Master Mode
Each of these modes are described, in detail, below.
4.2.1.1
Mode 1 - The Serial/Loop-Timing Mode
The Behavior of the XRT74L73
If the XRT74L73 has been configured to operate in
this mode, then the XRT74L73 will behave as follows.
A. Loop-Timing (Uses the RxLineClk signal as the
Timing Reference)
Since the XRT74L73 is configured to operate in the
loop-timed mode, the Transmit Section (of the
XRT74L73) will use the RxLineClk input clock signal
(e.g., the Recovered Clock signal, from the LIU) as its
timing source. When the XRT74L73 is operating in
this mode it will do the following.
1.
It will ignore any signal at the TxInClk input pin.
2.
The XRT74L73 will output a 44.736MHz clock
signal via the RxOutClk output pin. This clock
signal functions as the Transmit Payload Data
Input Interface block clock signal.
3.
The XRT74L73 will use the rising edge of the
RxOutClk signal to latch in the data residing on
the TxSer input pin.
B. Serial Mode
The XRT74L73 will accept the DS3 payload data
from the Terminal Equipment, in a serial-manner, via
the TxSer input pin The Transmit Payload Data Input
TxFrame
Output
Transmit End of Frame Output Indicator:
The Transmit Section of the XRT74L73 will pulse this output pin "High" (for one bit-period),
when the Transmit Payload Data Input Interface is processing the last bit of a given DS3
frame.
The purpose of this output pin is to alert the Terminal Equipment that it needs to begin trans-
mission of a new DS3 frame to the XRT74L73 (e.g., to permit the XRT74L73 to maintain
Transmit DS3 framing alignment control over the Terminal Equipment).
TxFrameRef
Input
Transmit Frame Reference Input:
The XRT74L73 permits the configuration of the Transmit Section to use this input pin as a
frame reference. If this configuration is selected, then the Transmit Section will initiate its
transmission of a new DS3 frame, upon the rising edge of this signal.
The purpose of this input pin is to permit the Terminal Equipment to maintain Transmit DS3
Framing alignment control over the XRT74L73.
RxOutClk
Output
Loop-Timed Timing Reference Clock Output pin:
The Transmit Section of the XRT74L73 can be configured to use the RxLineClk signal as the
Timing Reference (e.g., loop-timing). If this configuration is selected, then the XRT74L73 will:
Output a 44.736 MHz clock signal via this pin, to the Terminal Equipment.
Sample the data on the TxSer input pin, upon the rising edge of this clock signal.
T
ABLE
34: L
ISTING
AND
D
ESCRIPTION
OF
THE
PINS
ASSOCIATED
WITH
THE
T
RANSMIT
P
AYLOAD
D
ATA
I
NPUT
I
NTERFACE
S
IGNAL
N
AME
T
YPE
D
ESCRIPTION
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PDF描述
XRT74L74 4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
XRT74L74IB 4 CHANNEL, ATM UNI/PPP DS3/E3 FRAMING CONTROLLER
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XRT75L00DIV E3/DS3/STS-1 LINE INTERFACE UNIT WITH SONET DESYNCHRONIZER
XRT75L02 TWO CHANNEL E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER
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